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xilinx ise 是什么？ 的查询结果
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技术资料 《工作赢在心态》读后感
“心态成就一切”。我始终把责任作为我工作的航标，工作中保持良好的心态，踏踏实实的做好自己的本职。一个幼儿教师，一个合格的幼儿教师，首先要具备的是什么？可能有人会说：是扎实的基本功，是爱。这些我都赞同，但我觉得最应该具备的是强烈的责任心，责任感，没有强烈的责任感，责任心，一切都无从谈起。 ...
技术资料 基于Virtex-ⅡPro系列FPGA的SAR实时成像处理器中FFT的硬件实现.rar
合成孔径雷达(SAR)利用合成孔径原理和脉冲压缩技术，突破了天线孔径对方位向分辨率的限制，实现了对远距离目标进行二维高分辨率成像，在军事和民用领域都取得了广泛的应用。 快速傅立业变换(FFT)是雷达成像算法的核心，而雷达信号处理要求大动态范围和高精度使得其运算多用浮点格式完成。因此，如何快速有效的完成长点数浮 ...
技术资料 FPGA 在数字下变频设计中的应用
摘要:提出一种基于Xilinx 公司Virtex - 5 FPGA 的高速数字下变频的实现方法，使用System Generator for DSP 软件
实现IP Core 在FPGA 中的建模，通过Matlab 进行了仿真验证，并下载到FPGA 芯片中进行了功能验证，证明该设计集成度
高和稳定性强，降低了开发成本. ...
技术资料 中值滤波器verilog实现
这份详尽的中值滤波器Verilog实现代码，专为Xilinx FPGA平台设计。采用3*3模板，处理9个数据输入并输出中值，适用于图像处理和噪声抑制等场景。该资源不仅提供了完整的Verilog代码，还附带了详细的注释和测试案例，帮助工程师快速理解和应用。免费下载，完整无缺。 ...
教程资料 基于FPGA的多路高速串并转换器设计
高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISE ...
可编程逻辑 基于FPGA的多路高速串并转换器设计
高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISE ...
Java编程 前段时间找到一本书的源代码
前段时间找到一本书的源代码，可惜源代码文件全部是大写的，想执行都得一个一个地改文件名。很麻烦。所以写了个程序，把路径输入，就可以将文件夹下的所有 文件全部转换为大写字母文件或小写字母文件。
虽然不是什么好东东，但如果有朋友遇到这样我这样问题的时候，就可以拿这个东西帮忙了。
运行环境：JDK1.5 或更高。 ...
技术资料 STM32H7的FMC外设在D_Cache使能的情况下运行不正常
前段时间接到一个客户的问题。客户描述在使用STM32H7的FMC时，如果使能了DCACHE，就运行不正常。数据没有写到FMC外部的存储器里，测量FMC接口也没有波形跳变。而不使能DCACHE工作就是正常的。 其实对于这个问题，如果了解STM32H7的架构的话，就很容易理解了。下面我们就来看一看到底是什么原因让客户觉得使能DCACHE后FMC就 ...
技术资料 电工基础知识入门
现实生活中，我们经常听到或说起很多有关电方面的名词、术语，也经常有很多用电方面的困惑。这些名词、术语究竟是怎样定义的?它们之间有什么关系?是什么因素导致电压的高低、电流的大小?为什么会发生由用电引发的火灾?为什么家里几个月没人住，还会产生电费?很多经常听到的，看似简单，又不容易说清的问题，通过本章的学习 ...
学术论文 基于FPGA的Viterbi译码器设计与实现.rar
卷积码是广泛应用于卫星通信、无线通信等多种通信系统的信道编码方式。Viterbi算法是卷积码的最大似然译码算法，该算法译码性能好、速度快，并且硬件实现结构比较简单，是最佳的卷积码译码算法。随着可编程逻辑技术的不断发展，使用FPGA实现Viterbi译码器的设计方法逐渐成为主流。不同通信系统所选用的卷积码不同，因此设计 ...