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文章/文档  提出了一个采用(2,1,7)卷积码+QPSK的中频调制解调方案,并在Xilinx公司的100万门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率

提出了一个采用(2,1,7)卷积码+QPSK的中频调制解调方案,并在Xilinx公司的100万门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率小于10-5的数据传输。

https://www.eeworm.com/dl/652/421377.html

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VHDL/FPGA/Verilog In this paper, a new method is introduced to implement chaotic generators based on the Henon map and

In this paper, a new method is introduced to implement chaotic generators based on the Henon map and Lorenz chaotic generators given by the state equations using the Field Programmable Gate Array (FPGA). The aim of this method is to increase the frequency of the chaotic generators. The new method is ...

https://www.eeworm.com/dl/663/469409.html

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introduced generators implement chaotic

技术资料  以太网FPGA代码

详细说明：具备GMII接口和ARP协议功能的千兆以太网控制器。经过Xilinx SPATAN-III FPGA验证, Verilog描述-With GMII interface and feature ARP protocol Gigabit Ethernet controller. After Xilinx SPATAN-III FPGA verification, Verilog description

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FPGA 以太网代码

技术资料  用CPLD实现单片机读写模块

介绍实现单片机与Xilinx公司XC9500系列可编程逻辑器件的读写逻辑功能模块的接口设计，以及Xilinx 公司的XC9500 系列可编程逻辑器件的开发流程。

https://www.eeworm.com/dl/910442.html

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CPLD 实现单片机

技术资料  用CPLD 实现单片机读写模块

介绍实现单片机与Xilinx公司XC9500系列可编程逻辑器件的读写逻辑功能模块的接口设计，以及Xilinx 公司的XC9500 系列可编程逻辑器件的开发流程。

https://www.eeworm.com/dl/917924.html

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CPLD 实现单片机

VHDL/FPGA/Verilog 摄像头的硬件函数

摄像头的硬件函数，ip核，用于xilinx公司的virtex4 fpga

https://www.eeworm.com/dl/663/340163.html

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摄像头函数硬件

单片机开发  关于FPGA中DDS核参数设置的资料

关于FPGA中DDS核参数设置的资料，英文版的XILINX资料

https://www.eeworm.com/dl/648/452901.html

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FPGA DDS 参数

技术资料  FPGA的设计全流程

FPGA设计全流程十分钟学会Xilinx FPGA 设计

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fpga 设计

技术资料  vivado 2015 license

xilinx开发软件vivado的最新license，代理商提供，放心使用

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vivado license

技术资料  正弦函数代码verilog

利用xilinx的IP核ROM加载此文件可直接产生正弦波信号

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verilog 正弦函数代码

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