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技术资料  KC705 MIG Design Creation-vivado

介绍利用Xilinx开发工具vivado利用MIG产生DDR3的控制器IP核。

https://www.eeworm.com/dl/867710.html

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kc705 vivado DDR3

技术资料  zynq系列书籍

清华大学出版社何宾教授出版的xilinx公司zynq系列书籍的pPT

https://www.eeworm.com/dl/872808.html

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zynq 书籍

技术资料  XC4000系列的Select-RAM(TM)可配置成边沿触发RAM和双口RAM,边沿触发简化系统定时,双口RAM简化FIFO的设计

The XC4000E FPGA family is a pin- and bitstream-compatiblesuperset of the Xilinx XC4000 FPGA fam

https://www.eeworm.com/dl/922915.html

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Select-RAM 4000

技术资料  pcie

完成PCIe x1 DMA功能。在xilinx V5，sparten6，等器件上验证

https://www.eeworm.com/dl/924533.html

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pcie

技术资料  spartan6开发板的led流水灯实验

ISE软件设计的Xilinx的fpga spartan6开发板的led流水灯实验

https://www.eeworm.com/dl/987766.html

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spartan6 开发板

教程资料  EDK9．1i和ISE9．1i等工具的设计使用流程

介绍了Xilinx最新的EDK9．1i和ISE9．1i等工具的设计使用流程

https://www.eeworm.com/dl/fpga/doc/17983.html

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EDK9 ISE9 流程

教程资料  在文件夹YL2440_CPLD中有做好的CPLD工程

在文件夹YL2440_CPLD中有做好的CPLD工程,请用Xilinx ISE 6.2打开.

https://www.eeworm.com/dl/Protel/doc/18345.html

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CPLD 2440 YL 工程

VHDL/FPGA/Verilog 用FPGA模拟VGA时序、模拟PS/2总线的键盘接口VHDL源代码

用FPGA模拟VGA时序、模拟PS/2总线的键盘接口VHDL源代码，基于Xilinx spartan3

https://www.eeworm.com/dl/663/175328.html

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FPGA VHDL VGA 模拟

VHDL/FPGA/Verilog FM收音机的解码及控制器VHDL语言实现

FM收音机的解码及控制器VHDL语言实现，Xilinx提供的．别谢我．

https://www.eeworm.com/dl/663/176099.html

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VHDL FM收音机解码控制器

通讯编程文档  verilog编写的时钟控制程序

verilog编写的时钟控制程序，在xilinx芯片上开发。具有案件防抖等考虑，

https://www.eeworm.com/dl/646/343963.html

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verilog 编写时钟控制程序

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