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vhdl 的查询结果
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精品软件 QUARTUS II 14.0
Quartus II 是Altera公司的综合性PLD/FPGA开发软件，支持原理图、VHDL、VerilogHDL以及AHDL（Altera Hardware Description Language）等多种设计输入形式，内嵌自有的综合器以及仿真器，可以完成从设计输入到硬件配置的完整PLD设计流程。
学术论文 计算机组成实验平台的设计与实现
《计算机组成原理》是计算机系的一门核心课程。但是它涉及的知识面非常广，内容包括中央处理器、指令系统、存储系统、总线和输入输出系统等方面，学生在学习该课程时，普遍觉得内容抽象难于理解。但借助于该计算机组成原理实验系统，学生通过实验环节，可以进一步融会贯通学习内容，掌握计算机各模块的工作原理，相互关系的 ...
技术资料 计算机组成实验平台的设计与实现
《计算机组成原理》是计算机系的一门核心课程。但是它涉及的知识面非常广，内容包括中央处理器、指令系统、存储系统、总线和输入输出系统等方面，学生在学习该课程时，普遍觉得内容抽象难于理解。但借助于该计算机组成原理实验系统，学生通过实验环节，可以进一步融会贯通学习内容，掌握计算机各模块的工作原理，相互关系的 ...
教程资料 FPGA的串行通信UART控制器
基于FPGA的串行通信UART控制器，采用VHDL语言编写，包含多个子模块。\r\n在ISE或FPGA的其它开发环境下新建一个工程，然后将文档中的各个模块程序添加进去，即可运行仿真。源程序已经过本人的仿真验证。
文章/文档 基于FPGA的串行通信UART控制器
基于FPGA的串行通信UART控制器，采用VHDL语言编写，包含多个子模块。
在ISE或FPGA的其它开发环境下新建一个工程，然后将文档中的各个模块程序添加进去，即可运行仿真。源程序已经过本人的仿真验证。
单片机开发 循环冗余码校验（CRC）是一种可靠性很高的串行数据校验方法。介质循环冗余码校验的基本原理
循环冗余码校验（CRC）是一种可靠性很高的串行数据校验方法。介质循环冗余码校验的基本原理，并分别用单片机和CPLD作了循环冗余码验的软件实现和硬件实现。包括汇编语言和VHDL语言源程序
VHDL/FPGA/Verilog 测试人体视觉的反应时间
测试人体视觉的反应时间，可以作为vhdl编程的练习之用，也可以更进一步的开发成为具有商业价值的产品，这里面只是能够实现测试人体视觉反应时间的基本功能的程序
VHDL/FPGA/Verilog 共6个尾灯
共6个尾灯，汽车正常行驶时，6个灯全灭；
左转时，左边3个灯从右到左依次亮灭；
右转时，右边3个灯从左到右依次亮灭；
刹车时，车灯全亮；故障时，全部闪烁。
在软件工具平台上，进行VHDL语言的各模块编程输入、编译实现和仿真验证。 ...
VHDL/FPGA/Verilog 实验图1是一含计数使能、异步复位和计数值并行预置功能4位加法计数器
实验图1是一含计数使能、异步复位和计数值并行预置功能4位加法计数器，例1是其VHDL描述。由实验图1所示，图中间是4位锁存器；rst是异步清信号，高电平有效；clk是锁存信号；
技术资料 基于AES的低成本可重构高速加密引擎
针对商业加密引擎中硬件资源和电路性能平衡问题，提出一种基于AES的低成本可重构的高速加密引擎的设计方案。该方案在AES加密算法的基础上，根据FPGA内在的结构特点，利用VHDL语言对其加密模块进行描述