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vhdl 的查询结果
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VHDL/FPGA/Verilog 是关于对数据采集卡的基于PC104总线的读写程序
是关于对数据采集卡的基于PC104总线的读写程序，开发环境Quarters , 用VHDL语言编写。
VHDL/FPGA/Verilog 基于SMART-I实验平台的时钟电路设计与实现
基于SMART-I实验平台的时钟电路设计与实现，利用vhdl编程进行仿真，并且下载实现，功能正确
VHDL/FPGA/Verilog 本程序以ISE为开发平台
本程序以ISE为开发平台，采用VHDL为开发语言，实现了对一个时钟信号延时的功能
VHDL/FPGA/Verilog sin產生器
sin產生器，可以於VHDL產生sin之數值波形，進而輸出至dac做轉換
VHDL/FPGA/Verilog 自我实现的加法和四位数相乘的程序
自我实现的加法和四位数相乘的程序，很不错的，用于vhdl的编程
VHDL/FPGA/Verilog 有两个
有两个，一个用VHDL编写的I2C，一个Verilog hdl语言编写的
VHDL/FPGA/Verilog 一组练习
一组练习，关于VHDL的一些基础的知识和练习可以参考一些具体的问题