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系统设计方案  介绍了锁相环PLL的实现原理

介绍了锁相环PLL的实现原理，可以为VHDL实现PLL提供参考。

https://www.eeworm.com/dl/678/199318.html

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PLL 锁相环

嵌入式/单片机编程  用于CPLD的控制

用于CPLD的控制，VHDL编程，实现控制三相步进电机的正反转。

https://www.eeworm.com/dl/647/204639.html

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CPLD 控制

VHDL/FPGA/Verilog 与PS2的通信

与PS2的通信，PS2按键值发给LCD显示，VHDL语言。

https://www.eeworm.com/dl/663/210228.html

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PS2 通信

其他  FPGA连接SDRAM的源程序

FPGA连接SDRAM的源程序，VHDL语言实现，功能基本完全。应用效果好。

https://www.eeworm.com/dl/534/242401.html

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SDRAM FPGA 连接源程序

电子书籍  关于数字信号处理的文献

关于数字信号处理的文献，主要应用与fpga，用的是vhdl语言

https://www.eeworm.com/dl/cadence/ebook/253307.html

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数字信号处理

VHDL/FPGA/Verilog 开发环境是FPGA开发工具

开发环境是FPGA开发工具，格雷码计数器的VHDL程序

https://www.eeworm.com/dl/663/258799.html

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FPGA 开发环境开发工具

VHDL/FPGA/Verilog synplicity学习资料

synplicity学习资料，文章详细介绍了vhdl在该仿真软件中的仿真过程

https://www.eeworm.com/dl/663/283848.html

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synplicity

VHDL/FPGA/Verilog FPGA驱动数码管

FPGA驱动数码管，本人编写的vhdl源程序，QUARTUS II调试成功

https://www.eeworm.com/dl/663/286046.html

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FPGA 驱动数码管

VHDL/FPGA/Verilog 这是我的毕业设计

这是我的毕业设计，是用VHDL编程的直接扩频发生器。

https://www.eeworm.com/dl/663/298792.html

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毕业设计

其他书籍  HDB3编解码

HDB3编解码，含时钟提取，极高的效率和可靠性，VHDL。

https://www.eeworm.com/dl/542/299194.html

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HDB3 编解码

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