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VHDL/FPGA/Verilog
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这是我的毕业设计
这是我的毕业设计
VHDL/FPGA/Verilog
450 K
104 次下载
2013-12-10
资源详细信息
文件格式
RAR
文件大小
450 K
资源分类
VHDL/FPGA/Verilog
上传者
futianxiang0419
发布时间
2013-12-10 16:27
下载统计
104
次
所需积分
2 积分
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这是我的毕业设计,是用VHDL编程的直接扩频发生器。
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1
rst_gen.prj
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2
swepfre_pad.txt
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3
swep_fre.spl
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.untf
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swep_fre.stx
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6
swepfre.twx
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pepextractor.prj
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8
trunction.spl
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9
findcos_vhdl.prj
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10
findsin.sym
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11
_primary.dat
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12
behavioral.asm
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13
behavioral.dat
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_primary.dat
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15
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