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频率计VHDL编程。设计一个4位数字显示的十进制频率计，其测量范围为1MHz，测量值通过4个数码管显示以8421BCD码形式输出，可通过开关实现量程控制，量程分10kHz、100kHz、1MHz三档(最大读数分别为9.999kHz、99.99kHz、999.9kHz)；当输入信号的频率大于相应量程时，有溢出显示。 ...

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VHDL 频率计编程数字显示

VHDL/FPGA/Verilog 一个用vhdl硬件描述语言实现的一个比较简单的除法器

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vhdl 硬件描述语言比较除法器

VHDL/FPGA/Verilog This is 8bit multiplier VHDL code. It s consist of full adder, ripple carry adder(4bit, 8bit) multip

This is 8bit multiplier VHDL code. It s consist of full adder, ripple carry adder(4bit, 8bit) multiplier 8bit, and test bench file. This is a unsigned type.

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adder 8bit multiplier consist

VHDL/FPGA/Verilog vhdl 参考方面的一本不错的资料。对于初学者这个应该是不错的

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vhdl 方面初学者

VHDL/FPGA/Verilog 五阶椭圆滤波器硬件描述使用VHDL语言注释十分详细想要的赶紧下载吧

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https://www.eeworm.com/dl/663/482561.html

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VHDL 椭圆十分

VHDL/FPGA/Verilog 基于CPLD的数字通信系统 2fsk-2psk 用VHDL产生 2fsk-2psk信号

基于CPLD的数字通信系统 2fsk-2psk 用VHDL产生 2fsk-2psk信号

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fsk psk CPLD VHDL

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