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文章/文档  一种改进的一维DCT方案设计与实现,采用VHDL硬件语言描述,DCT以及IDCT

一种改进的一维DCT方案设计与实现,采用VHDL硬件语言描述,DCT以及IDCT

https://www.eeworm.com/dl/652/292800.html

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VHDL/FPGA/Verilog FSK和PSK调制与解调的VHDL源程序.是在QUARTUS2环境下开发的.

FSK和PSK调制与解调的VHDL源程序.是在QUARTUS2环境下开发的.

https://www.eeworm.com/dl/663/304770.html

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QUARTUS2 VHDL FSK PSK

VHDL/FPGA/Verilog HDB3码的VHDL实现共三个模块：插入V、插入B以及单双极性变换

HDB3码的VHDL实现共三个模块：插入V、插入B以及单双极性变换

https://www.eeworm.com/dl/663/313235.html

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HDB3 VHDL 模块双极性

VHDL/FPGA/Verilog 由VHDL写的多数决定的数字滤波器！QuartusII5.0的工程文件,编译通过！

由VHDL写的多数决定的数字滤波器！QuartusII5.0的工程文件,编译通过！

https://www.eeworm.com/dl/663/318344.html

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QuartusII VHDL 5.0 数字滤波器

VHDL/FPGA/Verilog 本例是一个6层电梯的控制系统,VHDL原程序,状态机,控制器

本例是一个6层电梯的控制系统,VHDL原程序,状态机,控制器

https://www.eeworm.com/dl/663/345010.html

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VHDL 电梯控制系统控制器

VHDL/FPGA/Verilog 用vhdl语言来实现四位并行加法器的功能是本科生的必学内容

用vhdl语言来实现四位并行加法器的功能是本科生的必学内容

https://www.eeworm.com/dl/663/359323.html

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vhdl 语言并行加法器

VHDL/FPGA/Verilog 0-99记数VHDL的源程序,综合实验指导书上的,可以用的大家下载哦

0-99记数VHDL的源程序,综合实验指导书上的,可以用的大家下载哦

https://www.eeworm.com/dl/663/364376.html

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VHDL 99 记数源程序

VHDL/FPGA/Verilog 这是一个在Quartus II软件中编写的vhdl程序。程序下载后可用蜂鸣器播放音乐

这是一个在Quartus II软件中编写的vhdl程序。程序下载后可用蜂鸣器播放音乐

https://www.eeworm.com/dl/663/364478.html

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Quartus vhdl 程序软件

VHDL/FPGA/Verilog 用来测试cpu的ram代码其中包括几十条指令 cpu的vhdl也在本站有下

用来测试cpu的ram代码其中包括几十条指令 cpu的vhdl也在本站有下

https://www.eeworm.com/dl/663/376569.html

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cpu vhdl ram 测试

VHDL/FPGA/Verilog 利用VHDL语言描述的5分频器（改变程序中m1,m2值

利用VHDL语言描述的5分频器（改变程序中m1,m2值，可作为任意奇数分频器）

https://www.eeworm.com/dl/663/376742.html

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VHDL 语言分频器改变

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