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https://www.eeworm.com/dl/663/209602.html VHDL/FPGA/Verilog

VHDL实现数字时钟

VHDL实现数字时钟，利用数码管和CPLD 设计的计数器实现一个数字时钟，可以显示小时，分钟，秒。程序主要要靠考虑十进制和六十进制计数器的编写。 以上实验的程序都在源代码中有详细的注释
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https://www.eeworm.com/dl/663/210404.html VHDL/FPGA/Verilog

mips prcessor in Verilog and vhdl

mips prcessor in Verilog and vhdl
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https://www.eeworm.com/dl/694/215971.html 并行计算

fifo vhdl源程序

fifo vhdl源程序
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https://www.eeworm.com/dl/663/221867.html VHDL/FPGA/Verilog

串uart的vhdl

串uart的vhdl，verilog，lattic实现原码 里面有四个文件,分别UART 源码 (lattice version)\uart 源码 (Verilog)\uart 源码 (VHDL)\uart16550.tar
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https://www.eeworm.com/dl/663/222008.html VHDL/FPGA/Verilog

VHDL计数器

VHDL计数器
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https://www.eeworm.com/dl/663/222238.html VHDL/FPGA/Verilog

riscMCU的VHDL实现

riscMCU的VHDL实现，内附有modelsim仿真testbench和文档说明
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https://www.eeworm.com/dl/540/226103.html 软件工程

vhdl语言设计资料

vhdl语言设计资料，学习FPGA设计的好书籍。
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https://www.eeworm.com/dl/684/227128.html 软件设计/软件工程

vhdl实例文件

vhdl实例文件
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https://www.eeworm.com/dl/534/228494.html 其他

vhdl代码多路开关

vhdl代码多路开关，小系统使用，非常方便
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https://www.eeworm.com/dl/663/233765.html VHDL/FPGA/Verilog

NCO的VHDL程序

NCO的VHDL程序，是利用IP核生成的，超好的，快下吧
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