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https://www.eeworm.com/dl/663/107655.html VHDL/FPGA/Verilog

VHDL的基本数学运算库,非常好用

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#VHDL #运算

https://www.eeworm.com/dl/663/107661.html VHDL/FPGA/Verilog

一篇用VHDL实现快速傅立叶变换的论文

一篇用VHDL实现快速傅立叶变换的论文，包括原理分析和代码实现，印度圣雄甘地大学M.A.学院提供

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#VHDL #傅立叶变换 #论文

https://www.eeworm.com/dl/663/119976.html VHDL/FPGA/Verilog

VHDL语言实现的16位快速乘法器

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#VHDL #语言 #乘法器

https://www.eeworm.com/dl/663/122078.html VHDL/FPGA/Verilog

USB 1.1 IP-CORE和设计范例 VHDL源代码

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#IP-CORE #VHDL #USB #1.1

https://www.eeworm.com/dl/663/123542.html VHDL/FPGA/Verilog

脉冲多普勒雷达回波信号相干积累的VHDL源程序

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#VHDL #脉冲 #多普勒 #信号

https://www.eeworm.com/dl/663/128055.html VHDL/FPGA/Verilog

maxplus2为开发环境 vhdl编写的键盘程序

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#maxplus2 #vhdl #开发环境 #编写

https://www.eeworm.com/dl/663/128056.html VHDL/FPGA/Verilog

maxplus2为开发环境 vhdl编写的扫描程序

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#maxplus2 #vhdl #开发环境 #编写

https://www.eeworm.com/dl/663/129810.html VHDL/FPGA/Verilog

用VHDL语言来实现一个电子时钟

用VHDL语言来实现一个电子时钟，可以调时间。小时，分，秒。可以下载到实验箱来运行验证。

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#VHDL #语言 #电子时钟

https://www.eeworm.com/dl/663/132039.html VHDL/FPGA/Verilog

Verilog&Vhdl混语言对SDRAM的控制源代码

Verilog&Vhdl混语言对SDRAM的控制源代码，提供了很好的例子，顶层文件为sdrm.v！

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#Verilog #SDRAM #Vhdl #语言

https://www.eeworm.com/dl/534/132324.html 其他

用VHDL语言编写的三人表决器

用VHDL语言编写的三人表决器，多数服从少数，或者一致通过。

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#VHDL #语言 #编写 #三人表决器