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技术资料  频率可调相位连续的DDS

采用Xilinx公司的FPGA设计了一个频率可调，相位连续的程序，采用Verilog语言实现正弦波。

https://www.eeworm.com/dl/864883.html

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FPGA 频率相位 DDS

技术资料  ad7175使用代码

ad7175是一款刚出来的芯片，这段程序是使用ad7175的配置代码，用verilog编写

https://www.eeworm.com/dl/867294.html

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verilog ad7175

技术资料  VHDL语言详解.pdf

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL语言详解.pdf

https://www.eeworm.com/dl/878467.html

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VHDL 详解

技术资料  序列检测器

利用数字信号状态机，借助Verilog硬件描述语言实现序列检测。能够检测输入信号中特定的序列。

https://www.eeworm.com/dl/887137.html

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序列检测器

技术资料  HDL设计资料.rar

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->HDL设计资料.rar

https://www.eeworm.com/dl/944442.html

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设计资料

技术资料  VHDL training.rar

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL training.rar

https://www.eeworm.com/dl/946854.html

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training VHDL

技术资料  3-8译码器

本文使用Verilog 实现一个简单的3-8 译码器，并在硬件上验证，供FPGA 初学者参考。

https://www.eeworm.com/dl/962580.html

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译码器

技术资料  秒脉冲

verilog硬件描述语言，发出一秒分频。理解的人可自己编译一下，改自己需要的频率。

https://www.eeworm.com/dl/967252.html

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秒脉冲

技术资料  spi 主机接口设计

这是一个经过实际运行验证的，可以综合到各种FPGA的SPI主机的设计过程，并附带了Verilog代码。

https://www.eeworm.com/dl/980051.html

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主机接口设计

VHDL/FPGA/Verilog 8bit采样sine波形发生器,一共两个文件

8bit采样sine波形发生器,一共两个文件，各自用VHDL和VERILOG编写，通信开发平台专用

https://www.eeworm.com/dl/663/151251.html

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8bit sine 采样波形发生器

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