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VHDL/FPGA/Verilog 实时电话计费系统是企业、事业单位信息管理的一个重要组成部分。介绍了一种用FPGA 器件实现电话计费系统 的方法, 并给出了设计框图和详细设计过程, 设计采用Verilog_HDL 硬件语言。
实时电话计费系统是企业、事业单位信息管理的一个重要组成部分。介绍了一种用FPGA 器件实现电话计费系统
的方法, 并给出了设计框图和详细设计过程, 设计采用Verilog_HDL 硬件语言。
数学计算 这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.
这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.
技术资料 单片机与嵌入式系统课程模块化教学方案在高职本科教育中的实施
针对高职本科的教育目标和“单片机与嵌入式系统”理论性与实践性强、课程难学的特点,提出一种课程模块化的教学方案,是在模块化教学理论基础上的一种创新,是知识结构模块化、课堂教学模块化、学习时间模块化、不同学生模块化的总称。它解决了课程技能点多、知识点杂,对于很多学生来说学起来困难,随着课程的深入会有越来越多 ...
教程资料 FPGA&SOPC快速入门教程(PDF)
FPGA&SOPC快速入门教程(PDF),基于Verilog HDL语言,开发环境Quartus
教程资料 adi串行AD9229的控制使用ISE平台
adi串行AD AD9229的控制使用ISE平台 Verilog语言\r\n
VHDL/FPGA/Verilog 512x8存储器模型,及其测试台
512x8存储器模型,及其测试台,用verilog写
VHDL/FPGA/Verilog 16-bit数的偶数奇偶校验及阶乘运算
16-bit数的偶数奇偶校验及阶乘运算,用verilog写
VHDL/FPGA/Verilog 16位高速加法器
16位高速加法器,采用verilog语言编写,已经成功仿真,能够运行