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技术资料  液晶

verilog程序.个大假参考。如有不对，恳请扶正。不胜感激。

https://www.eeworm.com/dl/978147.html

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液晶

技术资料  gold码发生器

verilog实现gold码的产生码片的长度为1023

https://www.eeworm.com/dl/984071.html

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gold 发生器

技术资料  FPGA点亮八盏LED灯源代码

用verilog HDL描述硬件语言编写，点亮八盏LED灯

https://www.eeworm.com/dl/985238.html

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FPGA

技术资料  占空比百分之五十三分频器

verilog三分频占空比50%，有波形图。

https://www.eeworm.com/dl/985869.html

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三分频

技术资料  ps2源码

PS2接口verilog源代码，包含工程文件和注释

https://www.eeworm.com/dl/986624.html

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源码

技术资料  vcs5.0

vcs5.0,verilog hdl快速，效率更更高的仿真工具

https://www.eeworm.com/dl/988080.html

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verilog

技术资料  FPGA实现串口通信

基于FPGA的串口通信，程序使用Verilog硬件描述语言。

https://www.eeworm.com/dl/989101.html

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FPGA 实现串口通信

VHDL/FPGA/Verilog 基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计&

基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计&#8226 测试&#8226 实验》课程中多功能数字钟实验所要求的所有功能和其它一些扩展功能。包括：基本功能——以数字形式显示时、分、秒的时间，小时计数器为同步24进制，可手 ...

https://www.eeworm.com/dl/663/202267.html

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Cyclone Verilog Altera 144C

VHDL/FPGA/Verilog 有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三利用条件语句实现计数分频时序电路实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Ver

有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三利用条件语句实现计数分频时序电路实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Verilog模块中应用计数器； 3. 学习测试模块的编写、综合和不同层次的仿真。练习四阻塞赋值与非阻塞赋值的区别实验目的： 1．通过实验，掌握阻塞赋值与 ...

https://www.eeworm.com/dl/663/368561.html

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Verilog MOSIN6 HDL Ver

Linux/Unix编程  Excellent Bootloader with a lot of features for arm, can be used for homebrew applications or for le

Excellent Bootloader with a lot of features for arm, can be used for homebrew applications or for learning how a bootloader works, it has support for networking and yet has a very small size. support for filesystems, flash disk, flash, cf etc present. ideal when you would like get ur board up and ru ...

https://www.eeworm.com/dl/619/292364.html

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for applications Bootloader Excellent

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VHDL/FPGA/Verilog 基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计&

VHDL/FPGA/Verilog 有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三利用条件语句实现计数分频时序电路实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Ver

Linux/Unix编程  Excellent Bootloader with a lot of features for arm, can be used for homebrew applications or for le