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VHDL/FPGA/Verilog 拿verilog和vhdl编写的串口通信代码(可综合)

拿verilog和vhdl编写的串口通信代码(可综合)

https://www.eeworm.com/dl/663/187275.html

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verilog vhdl 编写串口通信

VHDL/FPGA/Verilog 在quartusII下用verilog语言自己写的IP核

在quartusII下用verilog语言自己写的IP核，对FPGA开发初学者有帮助的。

https://www.eeworm.com/dl/663/200335.html

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quartusII verilog IP核语言

VHDL/FPGA/Verilog verilog编程ps2接口设计,基于fpga的设计

verilog编程ps2接口设计,基于fpga的设计

https://www.eeworm.com/dl/663/209611.html

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verilog fpga ps2 编程

VHDL/FPGA/Verilog iic implementation,用verilog实现了IIC标准协议的功能

iic implementation,用verilog实现了IIC标准协议的功能

https://www.eeworm.com/dl/663/211137.html

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implementation verilog iic IIC

其他嵌入式/单片机内容  verilog 编写的pic16c5x时钟模块

verilog 编写的pic16c5x时钟模块

https://www.eeworm.com/dl/687/213395.html

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verilog pic 16c 16

并行计算  这是一个用verilog实现的除法器代码。

这是一个用verilog实现的除法器代码。

https://www.eeworm.com/dl/694/213420.html

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verilog 除法器代码

其他嵌入式/单片机内容  verilog 实现帧同步,比较简短的一个程序

verilog 实现帧同步,比较简短的一个程序

https://www.eeworm.com/dl/687/214843.html

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verilog 帧同步比较程序

编译器/解释器  【原创】生成各个子模块verilog文件的顶层文件

【原创】生成各个子模块verilog文件的顶层文件，自动完成模块的互连。减少冗余的繁琐的劳动。提高工作效率。

https://www.eeworm.com/dl/628/216765.html

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verilog 子模块

VHDL/FPGA/Verilog uart串行口,用Verilog编写的.供大家参考

uart串行口,用Verilog编写的.供大家参考

https://www.eeworm.com/dl/663/223166.html

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Verilog uart 串行口编写

VHDL/FPGA/Verilog 在利用Verilog在FPGA平台上输出正弦波

在利用Verilog在FPGA平台上输出正弦波，实现芯片为Cyclone II 484C8，有管脚分配

https://www.eeworm.com/dl/663/227577.html

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Verilog FPGA 输出正弦波

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