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VHDL/FPGA/Verilog VERILOG Synchronous FIFO. 4 x 16 bit words.
VERILOG
Synchronous FIFO. 4 x 16 bit words.
操作系统开发 先进先出缓存器的verilog设计与实现
先进先出缓存器的verilog设计与实现
其他嵌入式/单片机内容 system C源码 一种替代verilog的语言
system C源码
一种替代verilog的语言
其他 Free ehternet mac using verilog downloaded in www.opencores.org
Free ehternet mac using verilog downloaded in www.opencores.org
VHDL/FPGA/Verilog Verilog是广泛应用的硬件描述语言
Verilog是广泛应用的硬件描述语言，可以用在硬件设计流程的建模、综合和模拟等多个阶段。随着硬件设计规模的不断扩大，应用硬件描述语言进行描述的CPLD结构，成为设计专用集成电路和其他集成电路的主流。通过应用Verilog HDL对多功能电子钟的设计，达到对Verilog HDL的理解，同时对CPLD器件进行简要了解。
本文的研究内容包 ...
VHDL/FPGA/Verilog 键盘鼠标的源码及约束（verilog）已用FPGA实现
键盘鼠标的源码及约束（verilog）已用FPGA实现
单片机开发 视频解压缩程序（用verilog语言实现）
视频解压缩程序（用verilog语言实现）
VHDL/FPGA/Verilog Altera 官方提供的SDRAM控制器,verilog的
Altera 官方提供的SDRAM控制器,verilog的
VHDL/FPGA/Verilog verilog code for 8-bit signed integers....its working
verilog code for 8-bit signed integers....its working
VHDL/FPGA/Verilog it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8
it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].you can use this code in any DSP project in which data entry is required.