搜索：verilog hdl 是什么？

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https://www.eeworm.com/dl/663/172729.html VHDL/FPGA/Verilog

interleaver即交织器

interleaver即交织器，里面包含有C,VHDL,VRILOG HDL三种语言写的交织器, 包括各种各样的组合达六七十种，描写详尽，是一个难得的学习交织器的材料
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https://www.eeworm.com/dl/877256.html 技术资料

QuartusII　Subscription Edition　10.1

EDA工具，QuartusII 与 MAX+PlusII 都是Altera专为其产品(hardware device)，所提供的EDA Tool。它可以执行HDL的编辑(Editor and syntax check) -->模拟(Simulator) -->合成(Synthesis) -->FPGA佈局 -->Netlist download to CPLD / FPGA。
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https://www.eeworm.com/dl/Protel/doc/17968.html 教程资料

等精度频率测量原理

主要介绍了等精度频率测量原理，该原理具有在整个测试频段内保持高精度频率\r\n测量的优点 同时在该原理基础上，采用了Verilog HDL语言设计了高速的等精度测频\r\n模块，并且利用EDA开发平台QUARTUS11 3 .0对CPLD芯片进行写人，实现了计数等\r\n主要逻辑功能 还使用C语言设计了该等精度频率计的主控程 ...
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https://www.eeworm.com/dl/957162.html 技术资料

基于FPGA的DSP总线实时监控系统设计

·摘要：  针对目前市场上DSP处理器可视性下降的问题,设计了一种可以对DSP处理器总线进行实时监控,从而为DSP调试提供有效支持的监控系统;该系统采用远程控制的方法切换工作模式提高了监控系统的灵活性,设计了相应的安全机制进一步提高了监控系统中数据传输的可靠性;监控系统采用Verilog HDL语言实 ...
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https://www.eeworm.com/dl/504/9944.html VHDL/Verilog/EDA源码

序列检测器

利用数字信号状态机，借助Verilog硬件描述语言实现序列检测。能够检测输入信号中特定的序列。
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https://www.eeworm.com/dl/504/16444.html VHDL/Verilog/EDA源码

秒脉冲

verilog硬件描述语言，发出一秒分频。理解的人可自己编译一下，改自己需要的频率。
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https://www.eeworm.com/dl/fpga/doc/17812.html 教程资料

《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计
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https://www.eeworm.com/dl/fpga/doc/18590.html 教程资料

《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计
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https://www.eeworm.com/dl/663/152454.html VHDL/FPGA/Verilog

usb1.0的核

usb1.0的核，有详细的usb核的设计源码，用verilog语言编写，同时附有相关的设计文档，质量不错
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https://www.eeworm.com/dl/663/174885.html VHDL/FPGA/Verilog

ATSC发送端部分

ATSC发送端部分，ATSC标准特有的TCM编码，共6个文件，包含tb文件，已通过仿真，没有问题，verilog代码
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