搜索：verilog hdl 是什么？

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https://www.eeworm.com/dl/945861.html 技术资料

基于FPGA的多功能实验板的设计

设计和实现了一个以Altera FPGA的Cyclone器件EP1C6Q240C8为核心的多功能实验板.它分为核心板和扩展板, 用户可以结合QuartusII集成开发环境, 使用VHDL语言、Verilog HDL语言或原理图, 进行编辑、综合和仿真, 通过本实验开发板加载配置并进行设计验证.经过测试验证了实验板的可行性和稳定性, 能够满足教 ...

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#FPGA

https://www.eeworm.com/dl/969476.html 技术资料

基于FPGA的32位除法器设计

Verilog HDL语言中虽然有除的运算指令，但是除运算符中的除数必须是2的幂，因此无法实现除数为任意整数的除法，很大程度上限制了它的使用领域。并且多数综合工具对于除运算指令不能综合出令人满意的结果，有些甚至不能给予综合。对于这种情况，一般使用相应的算法来实现除法，分为两类，基于减法操作和 ...

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#FPGA #32位

https://www.eeworm.com/dl/844815.html 技术资料

1.安装ActiveHDL83sp1_main_installation;2.将ibfs32.dll复制到D:\Aldec\Active-HDL 8.3\BIN下；3.将license_ActiveHDL82.dat复制到D:\Aldec\Active-HDL 8.3\Dat下；4.安装ActiveHDL83.2120.sp1_Update2_2011_05_09；5.安装ActiveHDL83sp1_Altera_Quartus10sp1_VHDLLibraries；6.设置环境变量:用户变量 ...

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#zynq7020 #fpga

https://www.eeworm.com/dl/901241.html 技术资料

EDA技术概述

EDA技术概述EDA技术的特点:􀂾采用HDL作为设计输入􀂾库的支持􀂾简化设计文档

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#技术 #概述

https://www.eeworm.com/dl/984956.html 技术资料

EDA

动态输出4位十进制频率计的设计,利用HDL语言，实施该功能，然后下到板子实现功能

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#功能 #动态

https://www.eeworm.com/dl/504/14022.html VHDL/Verilog/EDA源码

SDRAM 控制器

基于FPGA对sdram控制器的设计VERILOG语言

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#SDRAM #控制器

https://www.eeworm.com/dl/fpga/doc/18310.html 教程资料

fpga功能实现有限字长响应FIR

fpga功能实现有限字长响应FIR，用verilog编写

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#fpga #FIR #有限字长

https://www.eeworm.com/dl/663/110021.html VHDL/FPGA/Verilog

微处理机接口电路设计

微处理机接口电路设计，用verilog写

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#微处理机 #接口 #电路设计

https://www.eeworm.com/dl/687/210235.html 其他嵌入式/单片机内容

简易流水灯实验

简易流水灯实验，四灯依次点亮，循环VERILOG语言

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#流水灯 #实验

https://www.eeworm.com/dl/663/351933.html VHDL/FPGA/Verilog

用于dspbuilder 可以直接生成vhdl源码

用于dspbuilder 可以直接生成vhdl源码，或者verilog源码

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#dspbuilder #vhdl #源码