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https://www.eeworm.com/dl/663/155136.html VHDL/FPGA/Verilog

串口操作源代码

串口操作源代码，本代码采用veilog hdl语言编写，并经过本人多次验证。

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#串口 #操作 #源代码

https://www.eeworm.com/dl/663/468099.html VHDL/FPGA/Verilog

主要介绍moore状态机的详细功能及应用

主要介绍moore状态机的详细功能及应用，程序是用hdl写的！

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#moore #状态

https://www.eeworm.com/dl/902368.html 技术资料

CRC TOOLS

CRC 产生,对于任何多项式,可以直接产生FPGA所需要的HDL表达语言.

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#TOOLS

https://www.eeworm.com/dl/906400.html 技术资料

VHDL状态机

hdl逻辑编译器状态机部分说明以及应用！源程序机代码

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#VHDL

https://www.eeworm.com/dl/986206.html 技术资料

ddr_sdram

ddr_sdram 控制器HDL完成的srr文件，经过验证综合可以直接使用

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#ddr_sdram

https://www.eeworm.com/dl/828451.html 技术资料

8051软核处理器设计实战

使用Verilog语言从系统的角度编写8051软核，是学习Verilog语言的重要的资料。

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#8051 #处理器 #Verilog

https://www.eeworm.com/dl/543/10882.html EDA相关

微电子工程师1.0

用户可以用这个软件定制一些常见的Verilog源代码。支持Verilog源代码的自动生成

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#1.0 #微电子 #工程师

https://www.eeworm.com/dl/840683.html 技术资料

systemverilog+数字系统设计 Digital System Design with SystemVerilog

国外system verilog的教材，从最基础的数字电路讲起，覆盖system verilog的各个方面

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#verilog #数字系统设计

https://www.eeworm.com/dl/904469.html 技术资料

微电子工程师1.0

用户可以用这个软件定制一些常见的Verilog源代码。支持Verilog源代码的自动生成

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#微电子 #工程师

https://www.eeworm.com/dl/884654.html 技术资料

testbench简单教程

verilog的testbech写法教程

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#testbench #教程