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技术资料  uart串口程序

此程序是使用quartus ii verilog语言编写的cyclone的串口驱动

https://www.eeworm.com/dl/998665.html

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uart 串口程序

技术资料  LCD1602

一个verilog的小程序，希望对初学者会有帮助

https://www.eeworm.com/dl/998858.html

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1602

VHDL/FPGA/Verilog 实时电话计费系统是企业、事业单位信息管理的一个重要组成部分。介绍了一种用FPGA 器件实现电话计费系统的方法, 并给出了设计框图和详细设计过程, 设计采用Verilog_HDL 硬件语言。

实时电话计费系统是企业、事业单位信息管理的一个重要组成部分。介绍了一种用FPGA 器件实现电话计费系统的方法, 并给出了设计框图和详细设计过程, 设计采用Verilog_HDL 硬件语言。

https://www.eeworm.com/dl/663/337125.html

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Verilog_HDL FPGA 电话计费系统

数学计算  这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.

这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.

https://www.eeworm.com/dl/641/359141.html

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verilog booth hdl 家

教程资料  FPGA&SOPC快速入门教程(PDF)

FPGA&SOPC快速入门教程(PDF)，基于Verilog HDL语言，开发环境Quartus

https://www.eeworm.com/dl/fpga/doc/17911.html

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FPGA SOPC 快速入门

教程资料  adi串行AD9229的控制使用ISE平台

adi串行AD AD9229的控制使用ISE平台 Verilog语言\r\n

https://www.eeworm.com/dl/fpga/doc/18089.html

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9229 adi ISE AD

VHDL/FPGA/Verilog 512x8存储器模型,及其测试台

512x8存储器模型,及其测试台，用verilog写

https://www.eeworm.com/dl/663/110018.html

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512x8 存储器模型测试

VHDL/FPGA/Verilog 16-bit数的偶数奇偶校验及阶乘运算

16-bit数的偶数奇偶校验及阶乘运算，用verilog写

https://www.eeworm.com/dl/663/110020.html

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bit 16 奇偶校验运算

VHDL/FPGA/Verilog 16位高速加法器

16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行

https://www.eeworm.com/dl/663/152701.html

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加法器

VHDL/FPGA/Verilog 精简CPU设计

精简CPU设计，需要的可以下来看看,是VERILOG语言写的

https://www.eeworm.com/dl/663/214813.html

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CPU

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