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技术资料 verilog实现的AES-128加解密程序,FPGA验证通过

verilog实现的AES-128加解密程序,FPGA验证通过
https://www.eeworm.com/dl/836985.html
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技术资料 verilog-设计135个经典实例-fpga初学者适用

verilog-设计135个经典实例-fpga初学者适用,例子由浅入深
https://www.eeworm.com/dl/841172.html
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技术资料 使用Verilog-HDL设计2位-16进制计数器

实验目的:         学习计数器的设计、仿真和硬件测试方法。 实验内容及步骤:         1.使用Verilog HDL设计2位 16进制计数器,由DE2的KEY0输入计数值,在HEX1,HEX0上显示计数值。        2.使用嵌入式逻辑分析仪进行仿真;        3.将实验程序下载到DE2运行。 ...
https://www.eeworm.com/dl/845079.html
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技术资料 有限状态机和可综合风格的Verilog HDL

由于Verilog HDL和 VHDL 行为描述用于综合的历史还只有短短的几年,可综合风格的Verilog HDL 和VHDL的语法只是它们各自语言的一个子集。又由于HDL的可综合性研究近年来非常活跃,可综合子集的国际标准目前尚未最后形成,因此各厂商的综合器所支持的HDL子集也略有所不同。本教材中有关可综合风格的Verilog HDL的内容,我们只 ...
https://www.eeworm.com/dl/845560.html
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技术资料 16QAM调制与解调的Verilog语言的功能实现

16QAM调制与解调的Verilog语言的功能实现-the realization of 16QAM modulation and demodulation on Verilog language
https://www.eeworm.com/dl/854976.html
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技术资料 用verilog编程实现的基于FPGA的AD数据采集程序

用verilog编程实现的基于FPGA的AD数据采集程序,淘宝购买
https://www.eeworm.com/dl/858814.html
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技术资料 从零开始学CPLD和Verilog.HDL编程技术

从零开始学CPLD和Verilog.HDL编程技术
https://www.eeworm.com/dl/875904.html
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技术资料 一种SDRAM控制器软核的verilog设计

·学术论文   一种SDRAM控制器软核的verilog设计
https://www.eeworm.com/dl/879112.html
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技术资料 Verilog HDL数字设计与综合(第二版)

·本书从用户的角度全面阐述了Verilog HDL语言的重要细节和基本设计方法,并详细介绍了Verilog 2001版的主要改进部分。本书重点关注如何应用Verilog语言进行数字电路和系统的设计和验证,而不仅仅讲解语法。全书从基本概念讲起,并逐渐过渡到编程语言接口以及逻辑综合等高级主题。书中的内容全部符合Verilog HDL IEEE 1364- ...
https://www.eeworm.com/dl/883587.html
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技术资料 I2C总线串行数据接口的Verilog 实现

本文介绍了I2C总线规范,并根据该规范对I2C进行模块化设计,用Verilog HDL 语言对每个模块进行具体描述,并通过模块之间的调用,基本实现了I2C的主机从机的发送和接收功能。关
https://www.eeworm.com/dl/885715.html
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