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其他嵌入式/单片机内容  本原码是基于Verilog HDL语言的FPGA原程序

本原码是基于Verilog HDL语言的FPGA原程序，主要用于测频率，特点主要是可以更快地测频。实时性更高。

https://www.eeworm.com/dl/687/180077.html

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VHDL/FPGA/Verilog verilog HDL原码一种简单的同步FIFO原码

verilog HDL原码一种简单的同步FIFO原码，可以被综合

https://www.eeworm.com/dl/663/183280.html

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verilog FIFO HDL

VHDL/FPGA/Verilog 拿verilog编写的som(自适应神经网络算法)

拿verilog编写的som(自适应神经网络算法)，用于障碍物检测，基于FPGA可综合实验，已经在altera的cylcone上实现

https://www.eeworm.com/dl/663/187266.html

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verilog som 编写神经网络算法

VHDL/FPGA/Verilog 拿verilog和vhdl编写的串口通信代码(可综合)

拿verilog和vhdl编写的串口通信代码(可综合)

https://www.eeworm.com/dl/663/187275.html

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verilog vhdl 编写串口通信

VHDL/FPGA/Verilog 在quartusII下用verilog语言自己写的IP核

在quartusII下用verilog语言自己写的IP核，对FPGA开发初学者有帮助的。

https://www.eeworm.com/dl/663/200335.html

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quartusII verilog IP核语言

VHDL/FPGA/Verilog verilog编程ps2接口设计,基于fpga的设计

verilog编程ps2接口设计,基于fpga的设计

https://www.eeworm.com/dl/663/209611.html

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verilog fpga ps2 编程

VHDL/FPGA/Verilog iic implementation,用verilog实现了IIC标准协议的功能

iic implementation,用verilog实现了IIC标准协议的功能

https://www.eeworm.com/dl/663/211137.html

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implementation verilog iic IIC

其他嵌入式/单片机内容  verilog 编写的pic16c5x时钟模块

verilog 编写的pic16c5x时钟模块

https://www.eeworm.com/dl/687/213395.html

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verilog pic 16c 16

并行计算  这是一个用verilog实现的除法器代码。

这是一个用verilog实现的除法器代码。

https://www.eeworm.com/dl/694/213420.html

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verilog 除法器代码

其他嵌入式/单片机内容  verilog 实现帧同步,比较简短的一个程序

verilog 实现帧同步,比较简短的一个程序

https://www.eeworm.com/dl/687/214843.html

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verilog 帧同步比较程序

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