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可编程逻辑  基于Xilinx FPGA的双输出DC/DC转换器解决方案

&nbsp; Xilinx FPGAs require at least two power supplies: VCCINTfor core circuitry and VCCO for I/O interface. For the latestXilinx FPGAs, including Virtex-II Pro, Virtex-II and Spartan-3, a third auxiliary supply, VCCAUX may be needed. Inmost cases, VCCAUX can share a power supply with VCCO.The ...

https://www.eeworm.com/dl/kbcluoji/40111.html

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技术资料  epm1270iopin.rar

功耗是前一代CPLD系列的十分之一――MAX II器件的动态功耗很低，所以运行功耗较低。MAX II系列功耗是低成本MAX 3000A系列的十分之一。

https://www.eeworm.com/dl/907397.html

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iopin 1270

VHDL/FPGA/Verilog 高清电视HDTV信号发生器

高清电视HDTV信号发生器，576P逐行，VHDL语言，ALTERA的Quartus II开发平台

https://www.eeworm.com/dl/663/172201.html

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HDTV 高清电视信号发生器

操作系统开发  tcp/ip协议栈源码

tcp/ip协议栈源码，用于源码开放的嵌入式实时操作系统uCOS－II。

https://www.eeworm.com/dl/531/175591.html

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tcp ip 协议栈源码

VHDL/FPGA/Verilog 8位的加法器设计

8位的加法器设计，分4个工程完成的，用的是Quartus II软件。

https://www.eeworm.com/dl/663/213274.html

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8位加法器

VHDL/FPGA/Verilog SoC-Wishbone System IP核的VHDL语言源代码

SoC-Wishbone System IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。

https://www.eeworm.com/dl/663/271060.html

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SoC-Wishbone System VHDL IP核

VHDL/FPGA/Verilog ARM7系统IP核的VHDL语言源代码

ARM7系统IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。

https://www.eeworm.com/dl/663/271070.html

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ARM7 VHDL IP核

VHDL/FPGA/Verilog 键盘控制电路IP核的VHDL语言源代码

键盘控制电路IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。

https://www.eeworm.com/dl/663/271074.html

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VHDL 键盘控制电路 IP核

VHDL/FPGA/Verilog eeprom的Verilog HDL源代码

eeprom的Verilog HDL源代码，含eeprom的读写！Quartus II5.0平台测试通过！

https://www.eeworm.com/dl/663/281017.html

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Verilog eeprom HDL 源代码

Java编程  经典的Java学习材料电子版

经典的Java学习材料电子版，Core Java 2 Volume II。Prentice Hall公司出版的

https://www.eeworm.com/dl/633/296773.html

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Java 材料电子版

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