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maxplus 的查询结果
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文章/文档 数字钟电路系统由主体电路和扩展电路两大部分组成。其中
数字钟电路系统由主体电路和扩展电路两大部分组成。其中，主体电路完成数字钟的基本功能，扩展电路完成数字钟的扩展功能。用MAXPLUSⅡ进行电路设计与仿真.
VHDL/FPGA/Verilog 在本示例程序中
在本示例程序中，用VHDL语言实现了出租车的记价功能，在Maxplus2环境下编写，可通过cpld下载板来验证程序。在压缩包中附有示例的目的，方法和仿真时序图，是学习VHDL好例子。
技术资料 altera大量技术问题答复
我的设计板上没把象GCLK2这样的管脚接地，在max3000a用MAXPLUS2原理设计中设计成内部接地可以吗？
Bill Yuan答复：GClk2是全局输入信号管脚，如果不用一定要接地，否则会引入噪声而是的芯片工作不稳定
其他 MEALY状态机的输出是现态和输入的函数.在SRAM控制器状态机中,写有效WE不仅和WRITE状态有关,还和总线命令WRITE_MASK有关.这样,输出WE信号按设计要求表示为现态WRITE和现态输入
MEALY状态机的输出是现态和输入的函数.在SRAM控制器状态机中,写有效WE不仅和WRITE状态有关,还和总线命令WRITE_MASK有关.这样,输出WE信号按设计要求表示为现态WRITE和现态输入WRITE_MASK的函数.本程序基于VHDL,开发环境为MAXPLUS2
单片机开发 六十进制计数器.电子万年历是计数器的应用之一.年由月的十二进制计数器进位+1得到.月是日的三十进制计数器进位+1得到.日是小时的二十四进制计数器进位+1得到.小时是分的六十进制计数器进位+1得到.分是
六十进制计数器.电子万年历是计数器的应用之一.年由月的十二进制计数器进位+1得到.月是日的三十进制计数器进位+1得到.日是小时的二十四进制计数器进位+1得到.小时是分的六十进制计数器进位+1得到.分是秒的六十进制计数器进位+1得到.本程序基于VHDL.其开发环境是MAXPLUS2 ...
电子书籍 高级FPGA教学实验指导书－逻辑设计部分.pdf QuatusII5.0 是Altera 公司的最新产品。MaxplusII 是一套非常成功的PLD 开发软件
高级FPGA教学实验指导书－逻辑设计部分.pdf
QuatusII5.0 是Altera 公司的最新产品。MaxplusII 是一套非常成功的PLD 开发软件，
虽然QuartusII 已经推出了4 年，并且Altera 宣布不再对MaxplusII 进行升级，但至今仍
有非常多的工程师在使用MaxplusII。 Altera 在QuartusII 中允许将软件界面设置为
MaxplusII 风格，以吸引Max ...
学术论文 MBOK扩频调制技术及基于FPGA的实现研究
本文首先对目前使用比较多的几种扩频调制方式：BPSK调制方式、QPSK调制方式、CCK调制方式、MBOK调制方式进行了介绍，并从误码率、处理增益、频带利用率等方面对它们进行了比较，重点讨论了MBOK调制方式的优越性能。然后研究了MBOK调制方式的扩频和解扩方案，包括高速数据进行串并转换、扩频、伪码同步、解扩等。最后， ...
技术资料 MBOK扩频调制技术及基于FPGA的实现研究
本文首先对目前使用比较多的几种扩频调制方式：BPSK调制方式、QPSK调制方式、CCK调制方式、MBOK调制方式进行了介绍，并从误码率、处理增益、频带利用率等方面对它们进行了比较，重点讨论了MBOK调制方式的优越性能。然后研究了MBOK调制方式的扩频和解扩方案，包括高速数据进行串并转换、扩频、伪码同步、解扩等。最后， ...
教程资料 用CPLD控制LED、数码管的显示源代码
工作原理：\r\n 脉冲输入，记录30个脉冲的间隔时间（总时间），LED显示出来，牵涉到数码管的轮流点亮，以及LED的码。输入端口一定要用个\r\n74LS14整一下，图上没有。数码管使用共阴数码管。MAXPLUS编译。\r\n测试时将光电门的信号端一块连接到J2口的第三管脚，同时第一管脚为地，应该与光电门的地连接（共地）。\r\n开始测 ...
通信网络 一种点对点高速通信控制器的设计与实现
为了提高CPU模块之间的点对点通信速率，通过对以太网控制器MAC的研究，设计出一种点对点高速通信控制器。该控制器是基于媒体无关接口MII和以太网收发器的点对点高速通信控制器。利用VHDL语言编写该控制器的相关代码，使用MAXPLUSⅡ对该控制器的数据发送和数据接收进行仿真，并在实验室样机上进行实现。仿真结果和实验结果表 ...