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https://www.eeworm.com/dl/873166.html 技术资料

Libero软件生成IP核的方法

Libero软件生成IP核的方法,整个流程都有说明，比较详细。
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https://www.eeworm.com/dl/887111.html 技术资料

基于CPLD/FPGA的IP核设计

本文介绍了一个基于CPLD／FPGA的嵌入式IP核设计。论文在阐述可编程逻辑器件及其发展趋势的基础上，探讨了知识产权复用理念，MCU的复杂化设计以及数字信号传输与处理的速度要求。结合国内外对CPLD／FPGA的使用现状，引出了在CPLD／FPGA上开发嵌入式模块程序的理念并提出了设计实现方法和设计实例。课题 ...
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https://www.eeworm.com/dl/893806.html 技术资料

verilog 实现FFT IP核的控制

verilog 实现FFT IP核的控制 verilog 实现FFT IP核的控制
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https://www.eeworm.com/dl/979241.html 技术资料

DW8051IP核扩展设计

DW8051 IP核扩展设计，增加了jtag接口，可通过jtag下载程序并运行；增加了两个IO端口porta、portb。在QuartusII 11下验证通过。
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https://www.eeworm.com/dl/987292.html 技术资料

fft_IP核使用说明

在Quartus开发环境下，调用FFTIP核实现FFT算法及仿真
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https://www.eeworm.com/dl/514/10023.html 学术论文

基于FPGA的8051 IP核的设计

本文探索了自主系统CPU设计方法和经验，同时对80C51产品进行了必要的改进。 文章采用XILINX公司的Virtex-ⅡPro系列FPGA芯片，在相关EDA软件平台的支持下进行基于FPGA的8051芯片的设计。在已公开的8051源代码的基础上，对其中的程序存储器、指令存储器做了较大幅度的修改，增加了定时器、串行收发器的软 ...
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https://www.eeworm.com/dl/684/199411.html 软件设计/软件工程

LCD的通用驱动电路IP核设计.....

LCD的通用驱动电路IP核设计.....
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https://www.eeworm.com/dl/663/233510.html VHDL/FPGA/Verilog

这是一个fft的IP核

这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。
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https://www.eeworm.com/dl/663/257119.html VHDL/FPGA/Verilog

用VDHL编的8051ip核

用VDHL编的8051ip核，其为8位cpu代码，好东西，希望对大家有帮助！
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https://www.eeworm.com/dl/647/275552.html 嵌入式/单片机编程

altera 的i2c ip核

altera 的i2c ip核，可直接调用 在quartus中把库指向文件位置就可
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