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技术资料 Active HDL 9.1

Active-HDL是集成VHDL,Verilog,EDIF,System C开发环境美国、内华达州-提供ASIC及FPGA先进设计工具以及混合语言模拟的领导厂商-Aldec,Inc.,于近日宣布Active-HDL最新版本-Active-HDL 8.1,已于2008年09月11日正式上市。Active-HDL是集成VHDL,Verilog,EDIF,System C开发环境。它由设计工具,VHDl&Verilog编译器,单 ...
https://www.eeworm.com/dl/877255.html
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通信网络 基于主导节点竞争机制的802.11n协议性能分析

针对现有IEEE802.11n协议中存在的节点间竞争信道时冲突概率较大和系统吞吐量受限的问题,提出一种新的基于主导节点竞争的MAC信道接入机制。该方法根据节点的地理位置将所有节点分成若干个独立的区域组,每个组设一个主导节点,由主导节点竞争信道;当主导节点竞争到信道后,组中其他成员节点在主导节点发送完数据之后,根据 ...
https://www.eeworm.com/dl/564/32987.html
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其他 RADIUS 服务器介绍 RADIUS服务器支持标准的RADIUS协议

RADIUS 服务器介绍 RADIUS服务器支持标准的RADIUS协议,并支持设备提供商自己定义的扩展RADIUS属性,具有高稳定性、高性能、高度可配置性、高负荷量等特点,是宽带网络运营商理想的认证、授权、计费服务器。 特 点 ◆ 支持多种接入方式 PPPoE接入、DHCP+Web接入、专线接入、无线和有线LAN或WAN基于IEEE802.1x的接入 ◆ ...
https://www.eeworm.com/dl/534/139647.html
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技术资料 EtherCAT特点详解

符合IEEE802.3标准的以太网协议无需附加任何总线即可访间各个设备。耦合设备中的物理层由100BASE-TX或FX转换为E-bus,以满足电子端子排等模块化设备的需求。端子排内的E-bus信号类型(LVDS)并不是专用的,它还可用于10Gbit以太网。在端子排末端,物理总线特性被转换回100BASE-TX标准。主板集成的以太网MAC足以作为主站设备 ...
https://www.eeworm.com/dl/842692.html
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技术资料 高压大功率整流电路

摘要:当电动机容量较大时,大功率变频器的输入谐波对电网的影响以及输出谐波对电动机的影响成为了交流变频系统中突出的问题。为了减小大功率变频器的谐波,普遍采用多脉动整流、变压器耦合输出、多电平和单元级联技术,形成了以多脉动整流拓扑或多电平拓扑为输入级、以变压器耦合输出或多电平输出拓扑为输出级的大功率变频 ...
https://www.eeworm.com/dl/893241.html
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技术资料 高速FFT的FPGA实现.rar

OFDM调制系统的调制解调可以用快速傅立叶变换实现,本文的目的就是研究如何应用FPGA这种大规模可编程逻辑器件实现适用于OFDM系统的FFT算法。 本文首先从OFDM的基本原理着手,介绍了OFDM技术包括串并变换、子载波调制以及OFDM的DFT实现。接着对系统的定点分析模型进行讲解,即如何用定点的方式实现浮点FFT运算,并对设计的定 ...
https://www.eeworm.com/dl/896655.html
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技术资料 摩托罗拉GP2000对讲机维修手册

安全及一般信息安全和有效操作的重要信息。在使用您的双向对讲机之前.请阅读下列信息。本文提供的信息是取代2001年6月份前出版的用户手册,其中有关一般安全信息的内容。对于在危险环境范围里使用对讲机的安全信息,请参阅厂际公约许可手册补充或指示卡,该信息包含在提供这些性能的对讲机型号中。对讲机射频能量的操作按下 ...
https://www.eeworm.com/dl/840508.html
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传感与控制 LVDS和TTL板的接口定义及连接原理图

LVDS和TTL板的接口定义及连接原理图: TTL板与LVDS 相同 一、接口定义: 1、 LCD MODULE与驱动板之间的信号线接口定义如下:VDS接口又称RS-644总线接口,是20世纪90年代才出现的一种数据传输和接口技术。LVDS即低电压差分信号,这种技术的核心是采用极低的电压摆幅高速差动传输数据,可以实现点对点或一点对多点的连接,具 ...
https://www.eeworm.com/dl/562/34565.html
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matlab例程 基于Volterra滤波器混沌时间序列多步预测 作者:陆振波

基于Volterra滤波器混沌时间序列多步预测 作者:陆振波,海军工程大学 欢迎同行来信交流与合作,更多文章与程序下载请访问我的个人主页 电子邮件:luzhenbo@sina.com 个人主页:luzhenbo.88uu.com.cn 参考文献: 1、张家树.混沌时间序列的Volterra自适应预测.物理学报.2000.03 2、Scott C.Douglas, Teresa H.-Y. Meng, No ...
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技术资料 CPU可测试性设计

可测试性设计(Design-For-Testability,DFT)已经成为芯片设计中不可或缺的重要组成部分。它通过在芯片的逻辑设计中加入测试逻辑提高芯片的可测试性。在高性能通用 CPU 的设计中,可测试性设计技术得到了广泛的应用。本文结合几款流行的 CPU,综述了可应用于通用 CPU 等高性能芯片设计中的各种可测试性方法,包括扫描设计 ...
https://www.eeworm.com/dl/744116.html
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