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人工智能/神经网络  此程序为本人编写的神经网络法设计1型FIR滤波器的程序

此程序为本人编写的神经网络法设计1型FIR滤波器的程序，读者读此程序后，可以很深刻地理解如何用BP网络和LMS算法来设计滤波器。只需更改程序中的H值，即可生成各种低通，高通，带通，带阻滤波器。程序运行结果可得到滤波器系数，幅频曲线和衰减曲线。可通过更改迭代步长和误差极限来调整滤波器特性。 ...

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FIR 程序神经网络滤波器

VHDL/FPGA/Verilog 17阶FIR滤波器VHDL代码及说明文档下载立即可以仿真

17阶FIR滤波器VHDL代码及说明文档下载立即可以仿真

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VHDL FIR 滤波器代码

DSP编程  TI公司生产的C54系列DSP有限冲击响应滤波器（FIR）算法实验程序

TI公司生产的C54系列DSP有限冲击响应滤波器（FIR）算法实验程序

https://www.eeworm.com/dl/516/316213.html

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C54 DSP FIR TI公司

VHDL/FPGA/Verilog fir低通滤波器用于dspbuilder pll：25ns data 400khz sin 10.8khz

fir低通滤波器用于dspbuilder pll：25ns data 400khz sin 10.8khz

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dspbuilder khz 10.8 data

通讯/手机编程  采用不同的优化方法设计最优的标准多频带FIR数字滤波器。

采用不同的优化方法设计最优的标准多频带FIR数字滤波器。

https://www.eeworm.com/dl/527/409982.html

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FIR 标准多频带数字滤波器

Windows CE stepldr .S3C244X equipped with an internal SRAM buffer called 鈥楽teppingstone鈥? When booting, the fir

stepldr .S3C244X equipped with an internal SRAM buffer called 鈥楽teppingstone鈥? When booting, the first 4 KBytes of the NAND flash memory will be loaded into Steppingstone and the boot code loaded into Steppingstone will be executed.

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teppingstone equipped internal stepldr

VHDL/FPGA/Verilog verilog写的39阶通带为20KHz的半带fir滤波器

verilog写的39阶通带为20KHz的半带fir滤波器，经测试正确。

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verilog KHz fir 20

matlab例程  四种窗函数设计FIR数字滤波器matlab源码（hant,hamming,blackman,kaiser)

四种窗函数设计FIR数字滤波器matlab源码（hant,hamming,blackman,kaiser)

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blackman hamming matlab kaiser

其他  基于芯片TMS320C5500的40阶FIR滤波器的C程序代码

基于芯片TMS320C5500的40阶FIR滤波器的C程序代码，已测试通过

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C5500 320C 5500 TMS

DSP编程  针对在FPGA中实现FIR滤波器的关键--乘法运算的高效实现进行了研究

针对在FPGA中实现FIR滤波器的关键--乘法运算的高效实现进行了研究，给了了将乘法化为查表的DA算法，并采用这一算法设计了FIR滤波器。通过FPGA仿零点验证，证明了这一方法是可行和高效的，其实现的滤波器的性能优于用DSP和传统方法实现FIR滤波器。最后介绍整数的CSD表示和还处于研究阶段的根据FPGA实现的要求改进的最优表示 ...

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FPGA FIR 滤波器乘法运算

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