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Vhdl 的查询结果
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可编程逻辑 US Navy VHDL Modelling Guide
 
This document was developed under the Standard Hardware and Reliability Program (SHARP) TechnologyIndependent Representation of Electronic Products (TIREP) project. It is intended for use by VHSIC HardwareDescription Language (VHDL) design engineers and is offered as guidance for the deve ...
可编程逻辑 PLD Programming Using VHDL
本文详细讨论了VHDL语句对PLD设计的影响和设计经验，经典文章，值得仔细阅读消化。,PLD Programming Using VHDL
可编程逻辑 VHDL,Verilog,System verilog比较
 
本文简单讨论并总结了VHDL、Verilog，System verilog 这三中语言的各自特点和区别As the number of enhancements to variousHardware Description Languages (HDLs) hasincreased over the past year, so too has the complexityof determining which language is best fora particular design. Many designers ...
可编程逻辑 基于CPLD的VHDL语言数字钟(含秒表)设计
利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。
本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VH ...
可编程逻辑 ZBT SRAM控制器参考设计,xilinx提供VHDL代码
ZBT SRAM控制器参考设计,xilinx提供VHDL代码
Description:
  Contains the following files
    readme.txt appnote_zbtp.vhd appnote_zbtf.vhd appnote_zbt.ucf
Platform:
  All
Installation/Use:
  Use 'unzip' on the .zip file and 'gunzip' followed by & ...
可编程逻辑 USB接口控制器参考设计,xilinx提供VHDL代码 us
USB接口控制器参考设计,xilinx提供VHDL代码 usb xilinx vhdl
;  This program is free software; you can redistribute it and/or modify
;  it under the terms of the GNU General Public License as published by
;  the Free Software Foundation; either version 2 of the License, or
;  ...
可编程逻辑 ref sdr sdram vhdl代码
ref-sdr-sdram-vhdl代码
SDR SDRAM Controller v1.1 readme.txt
This readme file for the SDR SDRAM Controller includes information that was not
incorporated into the SDR SDRAM Controller White Paper v1.1.
The PLL is targeted at APEX(TM) devices. Please regenerate for your chosen architecture.
...
可编程逻辑 UART 4 UART参考设计，Xilinx提供VHDL代码
UART 4 UART参考设计，Xilinx提供VHDL代码 uart_vhdl
This zip file contains the following folders:
 \vhdl_source  -- Source VHDL files:
     uart.vhd  - top level file
     txmit.vhd - transmit portion of uart
 &nb ...
可编程逻辑 各种功能的计数器实例（VHDL源代码）
各种功能的计数器实例（VHDL源代码）:
可编程逻辑 各种功能的计数器实例（VHDL源代码）
各种功能的计数器实例（VHDL源代码）:ENTITY counters IS
 PORT
 (
  d  : IN  INTEGER RANGE 0 TO 255;
  clk  : IN BIT;
  clear : IN BIT;
  ld  : IN BIT;
  enable : IN BI ...