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技术资料  状态机

verilog开发所用到的状态机模板，对于状态机的学习有很大帮助

https://www.eeworm.com/dl/988130.html

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verilog

技术资料  EDA与硬件描述语言

EDA与硬件描述语言，介绍硬件描述语言，VHDL和verilog硬件描述语言。

https://www.eeworm.com/dl/998604.html

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硬件描述语言

精品软件  FPGA COMPLIERII V3.80

FPGA ComplierII,VHDL/Verilog综合软件，Synopsys公司将停止发展FPGAexpress软件，而转到FPGA ComplierII平台

https://www.eeworm.com/soft/168.html

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发动机燃烧技术

教程资料  液晶显示驱动源程序代码

液晶显示驱动源程序代码，所用芯片为ILI9325，用的是verilog 编写

https://www.eeworm.com/dl/fpga/doc/17889.html

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液晶显示代码驱动源程序

VHDL/FPGA/Verilog usb1.1的设备控制器IP核

usb1.1的设备控制器IP核，是用verilog硬件描述语言写的

https://www.eeworm.com/dl/663/124394.html

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usb 1.1 IP核设备

汇编语言  这是rs（255

这是rs（255，223）编码的verilog源程序。里面有：encode、decode、test－bench等文件。

https://www.eeworm.com/dl/644/176555.html

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255

VHDL/FPGA/Verilog 这是在FPGA上实现的数字钟功能

这是在FPGA上实现的数字钟功能，用VERILOG语言编程，已功过编译，仿真验证

https://www.eeworm.com/dl/663/213295.html

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FPGA 数字

VHDL/FPGA/Verilog RS编码

RS编码，verilog编写，可以自定义多项式，(255,233)和(204,188)均可。

https://www.eeworm.com/dl/663/258747.html

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RS编码

并行计算  采用匹配滤波

采用匹配滤波，实现伪码捕获功能，模块内部可以产生简单噪声来验证捕获性能(verilog)

https://www.eeworm.com/dl/694/278232.html

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滤波

VHDL/FPGA/Verilog Cores are generated from Confluence a modern logic design language. Confluence is a simple, yet high

Cores are generated from Confluence a modern logic design language. Confluence is a simple, yet highly expressive language that compiles into Verilog, VHDL, and C

https://www.eeworm.com/dl/663/310372.html

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Confluence generated language design

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