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Verilog HDL 的查询结果
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技术资料 Verilog实现奇数和偶数分频器和半整数及任意小数分频器程序
该文档为Verilog实现奇数和偶数分频器和半整数及任意小数分频器程序介绍,不错的文档
技术资料 Synopsys工具简介
VCS 是编译型Verilog 模拟器,它完全支持OVI 标准的Verilog HDL 语言、PLI 和SDF。VCS 具有目前行业中最高的模拟性能,其出色的内存管理能力足以支持千万门级的AS
技术资料 基于CPLD的双屏结构液晶控制器的研究与设计
可编程逻辑器件CPLD 体积小功能强大, Verilog HDL 语言简练,设计思想、电路结构和逻辑关系清晰,本文着重介绍使用Verilog 设计CPLD 实现双屏显示液晶控制器的功能。
VHDL/FPGA/Verilog 60秒秒表设计
60秒秒表设计,可暂停和分段计数等,所有功能是利用verilog HDL来描述,最后下载到CPLD/FPGA才能运行。
技术资料 VHDL 与数字电路设计.rar
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL 与数字电路设计.rar
技术资料 VHDL语言及其应用 156页.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL语言及其应用 156页.pdf
技术资料 八按键消抖控制LED亮灭
实现按键控制LED 亮灭。通过这个实验,掌握采用Verilog HDL 语言编程实
现按键控制LED 亮灭及按键消抖方法。
技术资料 FPGA的数字时钟的设计
该文档为基于FPGA的数字时钟的设计讲解文档,在QuartusⅡ开发环境下,用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字
时钟.通过将设计代码下载到FPGA的开发平台Ahera DE2开发板上进行了功能验证.由于数字时钟的通用性
及Verilog HDL语言的可移植性,冈此本数字时钟可直接应用于各种不同系列的FPGA芯片的 ...
教程资料 华为内部的FPGA设计培训教程
华为内部的FPGA设计培训教程,详细阐述了设计流程图、Verilog HDL设计、逻辑仿真、逻辑综合。对大家的学习一定有帮助的。
VHDL/FPGA/Verilog 华为内部的FPGA设计培训教程
华为内部的FPGA设计培训教程,详细阐述了设计流程图、Verilog HDL设计、逻辑仿真、逻辑综合。对大家的学习一定有帮助的。