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这是用pci-wishbone核和16450串口核在xilinx的fpga上实现的串口程序

这是用pci-wishbone核和16450串口核在xilinx的fpga上实现的串口程序，用verilog实现，ise7.1，不知道这里可不可以上传硬件的程序~

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#pci-wishbone #xilinx #16450 #fpga

https://www.eeworm.com/dl/514669.html 源码

交通灯设计，FPGA

基于FPGA的交通灯的设计有Verilog HDL代码

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#FPGA #交通灯

https://www.eeworm.com/dl/1000512.html 技术资料

fpga开发攻略

从基础逻辑设计到实际应用，循序渐进讲解FPGA开发全流程。涵盖Verilog/VHDL语法、时序分析与硬件优化技巧，适合初学者快速上手并深入掌握可编程逻辑设计核心技能。

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#FPGA #Verilog #VHDL #硬件开发

https://www.eeworm.com/dl/1003035.html 技术资料

基于FPGA的DDS设计

基于FPGA实现的直接数字频率合成器，采用Verilog硬件描述语言构建，具备高精度频率调节与低相位噪声特性，适用于通信和信号处理领域，可快速集成至开发项目中。

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#FPGA #DDS #Verilog #数字频率合成

https://www.eeworm.com/dl/1004764.html 技术资料

DSSS系统虚警概率和检测概率

DSSS系统虚警概率与检测概率的仿真代码，采用Verilog HDL实现，适用于通信系统性能分析与验证。包含核心算法与测试模块，便于理解扩频系统的工作原理和评估方法。

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#DSSS #Verilog #HDL #通信系统

https://www.eeworm.com/dl/1005074.html 技术资料

fifo+uart

基于Verilog实现的FIFO与UART发送模块，采用24位数据输入，通过串口稳定传输至PC。支持异步FIFO设计，符合UART通信标准，适用于嵌入式系统数据传输场景。

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#FIFO #UART #Verilog #异步通信

https://www.eeworm.com/dl/1005247.html 技术资料

基于FPGA信号发生器

基于FPGA实现的DDS信号发生器，采用Verilog编写，具备高精度频率控制和稳定输出特性，适用于通信测试与嵌入式系统开发，可直接用于生产环境的硬件设计中。

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#FPGA #DDS #信号发生器 #Verilog

https://www.eeworm.com/dl/663/247464.html VHDL/FPGA/Verilog

本程序对如何使用altera系列芯片片上ram进行实例演示

本程序对如何使用altera系列芯片片上ram进行实例演示，采用Verilog HDL语言编写，并使用modelsim与quartus联合进行功能仿真。本原码是红色逻辑开发板的试验程序，值得一看。

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#altera #ram #程序 #如何使用

https://www.eeworm.com/dl/667/267063.html 家庭/个人应用

用Altera公司的QuartusII编写的电子钟程序

用Altera公司的QuartusII编写的电子钟程序，可以下载至开发板，实现一个智能数字钟功能，计时，校时，闹钟，跑表等功能，也可用于学习verilog HDL语言与数字逻辑

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#QuartusII #Altera #编写 #电子钟

https://www.eeworm.com/dl/514668.html 源码

FPGA交通的设计

基于FPGA的交通灯的设计有Verilog HDL 源码，仅供参考

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#FPGA