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VHDL/FPGA/Verilog 王金明编写的《Verilog HDL程序设计教程》书中的例子原码

王金明编写的《Verilog HDL程序设计教程》书中的例子原码，适合于初学者。
https://www.eeworm.com/dl/663/297703.html
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VHDL/FPGA/Verilog I2C总线的逻辑代码.Verilog编写!很好用.调试成功.

I2C总线的逻辑代码.Verilog编写!很好用.调试成功.
https://www.eeworm.com/dl/663/303286.html
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其他书籍 (2003 prentice-hall)verilog hdl：a guide to digital design and synthesis(2nd edition).rar

(2003 prentice-hall)verilog hdl：a guide to digital design and synthesis(2nd edition).rar
https://www.eeworm.com/dl/542/304637.html
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VHDL/FPGA/Verilog 8x8DCT verilog code 一次輸入8個點

8x8DCT verilog code 一次輸入8個點
https://www.eeworm.com/dl/663/329295.html
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VHDL/FPGA/Verilog 8x8 iDCT verilog code 一次輸入八個點

8x8 iDCT verilog code 一次輸入八個點
https://www.eeworm.com/dl/663/329297.html
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VHDL/FPGA/Verilog 多工器ｖｅｒｉｌｏｇ設計1對多快速解碼提供控制功能

多工器ｖｅｒｉｌｏｇ設計1對多快速解碼提供控制功能
https://www.eeworm.com/dl/663/335383.html
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VHDL/FPGA/Verilog dp_xiliux 的 CPLD Verilog设计实验,流水灯演示.代码测试通过.

dp_xiliux 的 CPLD Verilog设计实验,流水灯演示.代码测试通过.
https://www.eeworm.com/dl/663/344457.html
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VHDL/FPGA/Verilog 0到255任意整数半整数分频Verilog HDL.rar

0到255任意整数半整数分频Verilog HDL.rar
https://www.eeworm.com/dl/663/349456.html
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VHDL/FPGA/Verilog altera fpga verilog 设计的基于查找表的DCT程序及zigzag扫描程序

altera fpga verilog 设计的基于查找表的DCT程序及zigzag扫描程序，已经过matlab 和modelsim 验证，文件中包含TESTBENCH ，直接可用
https://www.eeworm.com/dl/663/351808.html
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其他 A code writing by Verilog which can find medium value. With a C file to see the simulation results.

A code writing by Verilog which can find medium value. With a C file to see the simulation results. A co-design example of C and Verilog.
https://www.eeworm.com/dl/534/353416.html
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