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共 5,351 条结果

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VHDL/FPGA/Verilog 大屏幕led点阵显示的驱动时序。 使用vhdl语言描述。其中rom文件可以使用lpm_megcore自动生成。

大屏幕led点阵显示的驱动时序。 使用vhdl语言描述。其中rom文件可以使用lpm_megcore自动生成。
https://www.eeworm.com/dl/663/137126.html
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VHDL/FPGA/Verilog 使用vhdl语言在altera公司的up3板上产生vga信号

使用vhdl语言在altera公司的up3板上产生vga信号，里面有详细的解析和说明，是一个很好的教程。
https://www.eeworm.com/dl/663/137158.html
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VHDL/FPGA/Verilog 使用vhdl语言在altera公司的up3板上产生vga信号

使用vhdl语言在altera公司的up3板上产生vga信号，里面有详细的解析和说明，是一个很好的教程。和上一个文件razzle差不多，但是产生的效果不一样。
https://www.eeworm.com/dl/663/137159.html
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VHDL/FPGA/Verilog 是一个用vhdl语言编写的pwm程序

是一个用vhdl语言编写的pwm程序，可以方便地用来和nios连接，实现对nios的功能扩展。
https://www.eeworm.com/dl/663/137162.html
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VHDL/FPGA/Verilog DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M

DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M
https://www.eeworm.com/dl/663/137265.html
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VHDL/FPGA/Verilog VHDL小程序（本人的一些小成绩哦

VHDL小程序（本人的一些小成绩哦，希望对大家有帮助）
https://www.eeworm.com/dl/663/137409.html
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VHDL/FPGA/Verilog VHDL语言应用实例,计数器的设计,用GENERATE语句实现

VHDL语言应用实例,计数器的设计,用GENERATE语句实现
https://www.eeworm.com/dl/663/137515.html
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VHDL/FPGA/Verilog VHDL几个设计实例,用WHEN ELSE 语句实现条件赋值等

VHDL几个设计实例,用WHEN ELSE 语句实现条件赋值等
https://www.eeworm.com/dl/663/137517.html
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VHDL/FPGA/Verilog 步进电机控制器,控制电机的VHDL源程序

步进电机控制器,控制电机的VHDL源程序
https://www.eeworm.com/dl/663/137601.html
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VHDL/FPGA/Verilog 用VHDL实现的键盘扫描程序 可以稍微修改就可使用

用VHDL实现的键盘扫描程序 可以稍微修改就可使用
https://www.eeworm.com/dl/663/137697.html
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