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https://www.eeworm.com/dl/663/299649.html VHDL/FPGA/Verilog

在quartus 11 5.1 里用VHDL编写的正弦波发生器

在quartus 11 5.1 里用VHDL编写的正弦波发生器，经过仿真通过

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#quartus #VHDL #5.1 #11

https://www.eeworm.com/dl/663/300759.html VHDL/FPGA/Verilog

用VHDL语言采用串行方法实现用1位全加器实现4位全加器

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#VHDL #全加器 #语言 #串行

https://www.eeworm.com/dl/663/302042.html VHDL/FPGA/Verilog

正弦波发生器,VHDL的应用和处理,可以产生任意波形

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#VHDL #正弦波 #发生器 #任意波形

https://www.eeworm.com/dl/663/302137.html VHDL/FPGA/Verilog

一个三阶梳妆滤波器（CIC）的vhdl的源码

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#vhdl #CIC #滤波器 #源码

https://www.eeworm.com/dl/663/302837.html VHDL/FPGA/Verilog

一个简单的用vhdl写的计秒功能的小程序.

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#vhdl #程序

https://www.eeworm.com/dl/648/307856.html 单片机开发

VHDL程序结构与规则非常适合初学者和进阶绝对实用

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#VHDL #程序结构 #初学者 #进阶

https://www.eeworm.com/dl/663/308286.html VHDL/FPGA/Verilog

在EDA的MAX+PLUS II开发环境下用VHDL编写的全加器

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#PLUS #VHDL #EDA #MAX

https://www.eeworm.com/dl/663/311716.html VHDL/FPGA/Verilog

用VHDL写的带有防抖动功能的四位计数器

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#VHDL #防抖 #计数器

https://www.eeworm.com/dl/628/312826.html 编译器/解释器

在VHDL平台上实现HDB3编码的源程序已调试完

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#VHDL #HDB3 #编码 #源程序

https://www.eeworm.com/dl/663/324426.html VHDL/FPGA/Verilog

用VHDL原理图输入的方法实现d触发器的功能

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#VHDL #原理图 #输入 #触发器