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VERILOG-HDL 的查询结果
测试测量 基于FPGA的数据采集系统设计
设计了一个基于FPGA的数据采集系统，并用Verilog HDL语言作为描述语言实现了对TLC0820的采样控制和FPGA的数据处理等过程的控制，以Xilinx ISE 9.1i软件为平台，进行了设计输入、分析与综合、仿真与验证等过程仿真实现了这一系统。
EDA相关 multisim10.0仿真软件破解版下载
multisim10.0仿真软件破解版下载:【软件介绍】
Multisim本是加拿大图像交互技术公司（Interactive Image Technoligics简称IIT公司)推出的以Windows为基础的仿真工具，被美国NI公司收购后，更名为NI Multisim ，而V10.0是其（即NI，National Instruments）最新推出的Multisim最新版本。
目前美国NI公司的EWB的包含有电 ...
VHDL/FPGA/Verilog 课程设计要求设计并用FPGA实现一个数字频率计
课程设计要求设计并用FPGA实现一个数字频率计，具体设计要求如下： 测量频率范围： 10Hz～100KHz 精度： ΔF / F ≤ ±2 % 系统外部时钟： 1024Hz 测量波形： 方波 Vp-p ＝ 3～5 V 硬件设备：Altera Flex10K10 五位数码管 LED发光二极管 编程语言：Verilog HDL / VHDL ...
书籍源码 SystemC片上系统设计的源代码： 书籍介绍： SystemC是被实践证明的优秀的系统设计描述语言
SystemC片上系统设计的源代码：
书籍介绍：
SystemC是被实践证明的优秀的系统设计描述语言，它能够完成从系统到门级、从软件到硬件、从设计到验证的全部描述。SystemC 2.01已作为一个稳定的版本提交到IEEE，申请国际标准。
本书为配合清华大学电子工程系SystemC相关课程的教学而编写。全书分9章，内容包括：硬件描述语言的 ...
VHDL/FPGA/Verilog 简单的一个8位RISC
简单的一个8位RISC，Verilog HDL代码,类型为pic16c57
VHDL/FPGA/Verilog CRC校验码
CRC校验码，用于对数据流进行crc校验。
主要有CRC_16,CRC_8,CRC_32校验。
所用语言为Verilog HDL.
VHDL/FPGA/Verilog 循环冗余校验
循环冗余校验，crc_16,主要运用在数字通信系统。用Verilog HDL编写。
VHDL/FPGA/Verilog 出租车计价器
出租车计价器，简单、方便，采用verilog hdl语言编写，所用平台是MAXPLUS软件
VHDL/FPGA/Verilog 大型嵌入式设备FPGA程序
大型嵌入式设备FPGA程序，verilog HDL语言，实现DLL和PCM码流分流。
VHDL/FPGA/Verilog 一个带波形输出的扫频模板systemC源程序
一个带波形输出的扫频模板systemC源程序，
该程序在SystemCStudio开发平台下生成，
实现systemC仿真、波形显示以及自动生成Verilog HDL代码。