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VHDL/FPGA/Verilog 用VHDL和verilog实现的四人抢答器

用VHDL和verilog实现的四人抢答器

https://www.eeworm.com/dl/663/221861.html

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VHDL/FPGA/Verilog 用verilog实现了一个数字秒表的设计

用verilog实现了一个数字秒表的设计

https://www.eeworm.com/dl/663/221892.html

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VHDL/FPGA/Verilog 一个可以综合的Verilog 写的FIFO存储器内附文档说明

一个可以综合的Verilog 写的FIFO存储器内附文档说明

https://www.eeworm.com/dl/663/222236.html

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VHDL/FPGA/Verilog 8051的verilog实现

8051的verilog实现，内附testbench,c语言调试程序

https://www.eeworm.com/dl/663/222239.html

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其他嵌入式/单片机内容  FIFO的verilog实现

FIFO的verilog实现，内附testbench和文档说明

https://www.eeworm.com/dl/687/222240.html

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VHDL/FPGA/Verilog 该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码

该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码，会用QUATUSII的人都应该知道如何使用，希望能给你带来帮助

https://www.eeworm.com/dl/663/222998.html

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VHDL/FPGA/Verilog uart串行口,用Verilog编写的.供大家参考

uart串行口,用Verilog编写的.供大家参考

https://www.eeworm.com/dl/663/223166.html

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其他嵌入式/单片机内容  将16进制文件转换成RAM可读的文件,verilog语言编写

将16进制文件转换成RAM可读的文件,verilog语言编写

https://www.eeworm.com/dl/687/223228.html

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VHDL/FPGA/Verilog 基于Verilog 的电子日历与电子时钟程序

基于Verilog 的电子日历与电子时钟程序，可以进行调日期、星期、时间的分钟与小时，通过几种模式来显示日历与时间。

https://www.eeworm.com/dl/663/223925.html

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VHDL/FPGA/Verilog 基于Verilog的数码管模拟扫描程序

基于Verilog的数码管模拟扫描程序，分为两种显示方式，一种是数码管逐个显示，另一个是所有数码管一起显示。

https://www.eeworm.com/dl/663/223927.html

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