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VHDL/FPGA/Verilog EDA课程设计
EDA课程设计，包含源码和文档说明，实现秒表计数和闹钟功能，使用VHDL语言编写
已完成功能
1. 完成时／分／秒的依次显示并正确计数，利用六位数码管显示；
2. 时／分／秒各段个位满10正确进位，秒／分能做到满60向前进位，有系统时间清零功能；
3. 定时器：实现整点报时，通过扬声器发出高低报时声音；
4. 时间设置，也就 ...
Linux/Unix编程 linux程序设计
linux程序设计，详细讲述了linux下的c语言程序设计
编译器/解释器 一． 实验目的 设计
一． 实验目的
设计，编制并调试一个语法分析程序，加深对语法分析原理的理解。可以编译c语言的基本结构，包括循环嵌套和条件嵌套。
二． 实验的输入输出
(1) 执行程序时，可输入源程序的路径，如果输入为空的话，将会编译默认的源程序“./input.dat”
(2) 如果编译发现有错误，则会输出错误行数，并在结束编译时输出“Comp ...
Delphi/CppBuilder DELPHI设计模式书籍
DELPHI设计模式书籍