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TestBench 的查询结果
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VHDL/FPGA/Verilog 参数化FFT源代码
参数化FFT源代码，点数和位宽可变，内附testbench和说明文档
VHDL/FPGA/Verilog vhdl语言编写的AVR单片机IP核
vhdl语言编写的AVR单片机IP核，里面有testbench和说明文档。
VHDL/FPGA/Verilog 可以支持连续读写的i2cslave源码
可以支持连续读写的i2cslave源码，很适合作为master的testbench来用
无线通信 混合基dftc语言实现
c语言实现的dft，不需要修改，可以直接使用，里面有testbench，亲测有效
VHDL/FPGA/Verilog usb1.1的verilog源代码。以及其测试仿真文件
usb1.1的verilog源代码。以及其测试仿真文件，现在很难找其测试文件既testbench
微处理器开发 嵌入式risc处理器源码
嵌入式risc处理器源码，包含设计文档，原理图，testbench，及外围接口，使用verilog实现。
VHDL/FPGA/Verilog 自己写的
自己写的，对串口的VHDL描述，有完整testbench，特别是详细的功能说明和注释。
技术资料 新的工具语言Gv的开发环境
Gv是一种在芯片EDA仿真验证进行Testbench设计时用的命令解释型验证语言。
VHDL/FPGA/Verilog 我是VHDL的初学者
我是VHDL的初学者，这是我自己编译的简单的几个VHDL码，功能有3-8解码器及其testbench,16位寄存器及其testbench和交通灯。
希望能和其他初学者一起讨论学习，并得到高手的指点
其他书籍 是一个用于soc的32bit risc核
是一个用于soc的32bit risc核，文件包括了核的rtl代码，文档、testbench码。