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单片机开发 采用Quartus2编写的数码管扫描显示电路 共有三个电路 电路1：当按下启动计时按钮时
采用Quartus2编写的数码管扫描显示电路
共有三个电路
电路1：当按下启动计时按钮时，实验箱上的8个数码管数码1~8以4Hz的频率，从0到9反复不停计数，8个数码管同一时刻显示同一个数字。当按下异步清零按钮时，则8个数码管均显示为0。
电路2：当按下启动计时按钮时，8个数码管1~8以4Hz的频率完成从0到9的跳跃循环计数，即每一 ...
技术资料 基于FPGA的1553B总线编_解码器设计
本文在基于FPGA 的基础上设计实现1553B 总线接口板中的曼彻斯特II 型码的编、解码器。设计采用VHDL 语言, 使用Quartus II9
其他 这是我们做的一个作业 摸60计数器
这是我们做的一个作业 摸60计数器，用Quartus ii 做的 ，内容齐全 不可不看。
嵌入式综合 uCOS-III V3.03.01 uCOS-II V2.92.07在STM32F4移植
uCOS-III V3.03.01 uCOS-II V2.92.07在STM32F4移植
可编程逻辑 Nios II软件开发人员手册中的缓存和紧耦合存储器部分
        Nios II 软件开发人员手册中的缓存和紧耦合存储器部分
Nios® II embedded processor cores can contain instruction and data caches. This
chapter discusses cache-related issues that you need to consider to guarantee that
your program executes correctly on the ...
*行业应用 I. A brief description of the aiNet application. II. How to set up the aiNet on your system. III. So
I. A brief description of the aiNet application. II. How to set up the aiNet on your system. III. Some tips on using the aiNet IV. Example files
系统设计方案 上海热线ii试验网接入部分方案(上海贝尔有限公司) 毕业设计内参
上海热线ii试验网接入部分方案(上海贝尔有限公司) 毕业设计内参
VHDL/FPGA/Verilog 用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。
用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。
uCOS Porting UCOS-II v2.0 to S3C2410 with File System v1.34 and RAM driver
Porting UCOS-II v2.0 to S3C2410 with File System v1.34 and RAM driver
单片机开发 一些实用的uc_os_ii的源码。针对 AVR 的 非常的不错。找了好久
一些实用的uc_os_ii的源码。针对 AVR 的
非常的不错。找了好久，才找到的