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技术资料 级联编码在卫星通信中的应用及FPGA实现.rar

对某通信车载站接收机的级联编译码方法及其FPGA实现方法进行了研究,并最终用FPGA实现它,用于实际设备中。 首先介绍了系统的总体设计方案,接着分别分析了RS码、交织码和卷积码的编码及译码原理并给出其数学公式,详细介绍了RS译码器及全并行Viterbi译码器硬件实现方法,然后给出了整个系统基于Altera的FPGA的硬件具体实现 ...
https://www.eeworm.com/dl/898604.html
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技术资料 基于FPGA的多路码分复用通信系统实现

第三代移动通信系统及技术是目前通信领域的研究热点。本系统采用了第三代移动通信系统的部分关键技术,采用直接序列扩频方式实现多路宽带信号的码分复用传输。在系统设计中,我们综合考虑了系统性能要求,功能实现复杂度与系统资源利用率,选择了并行导频体制、串行滑动相关捕获方式、延迟锁相环跟踪机制、导频信道估计方案 ...
https://www.eeworm.com/dl/916922.html
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技术资料 FPGA的温度循环检测与报警系统的设计

“温度”是各类工业控制生产中常见的、而又十分重要的控制参数。人们研制出各种针对不同控制对象的温度自动控制系统,其中软件控制算法已比较成熟,但温度控制系统的硬件构成特别是功率控制部分往往存在着硬件结构复杂,分离元件较多,结构较为封闭等问题。随着FPGA器件的大规模运用,采用FPGA器件可简化控制系统的硬件结构 ...
https://www.eeworm.com/dl/841609.html
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技术资料 基于FPGA的回波抵消算法研究与实现.rar

回波抵消器作为消除通信系统中电学回波和声学回波的功能单元,在免提电话、无线产品、IP电话和电话会议等系统中有着非常重要的应用。传统回波抵消器主要是基于通用DSP处理器实现的。这种回波抵消器在系统实时性要求不高的场合能很好的满足回波抵消性能要求,但是在实时性要求较高的场合,其处理速度等性能方面已经不能满足 ...
https://www.eeworm.com/dl/896860.html
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技术资料 FIR数字滤波器的FPGA实现技术研究.rar

由于成本、系统功耗和面市时间等原因,许多通讯、视频和图像系统已无法简单地用现有DSP处理器来实现,现场可编程门阵列(FPGA)尤其适合于乘法和累加(MAC)等重复性的DSP任务。并且,由于在性能、成本、灵活性和功耗等方面的优势,基于FPGA的信号处理器已广泛应用于各种信号处理领域。FPGA提供了极强的灵活性,可让设计者开发 ...
https://www.eeworm.com/dl/897445.html
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技术资料 FIR数字滤波器的FPGA实现技术研究

由于成本、系统功耗和面市时间等原因,许多通讯、视频和图像系统已无法简单地用现有DSP处理器来实现,现场可编程门阵列(FPGA)尤其适合于乘法和累加(MAC)等重复性的DSP任务。并且,由于在性能、成本、灵活性和功耗等方面的优势,基于FPGA的信号处理器已广泛应用于各种信号处理领域。FPGA提供了极强的灵活性,可让设计者开发 ...
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教材/考试/认证 modelsim教程(中文)

Modelsim仿真工具是Model公司开发的。它支持Verilog、VHDL以及他们的混合仿真,它可以将整个程序分步执行,使设计者直接看到他的程序下一步要执行的语句,而且在程序执行的任何步骤任何时刻都可以查看任意变量的当前值,可以在Dataflow窗口查看某一单元或模块的输入输出的连续变化等,比Quartus自带的仿真器功能强大的多, ...
https://www.eeworm.com/dl/539/11633.html
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学术论文 高精度地震勘探数据采集系统

本文分析了当代高精度地震勘探数据采集系统的发展现状,研究了数据采集的A/D方法及理论、现场可编程门阵列(Field Programmable GateArray,FPGA)技术的发展及原理,串口通信的原理及实现。在此基础上,探讨了采用FPGA控制24位△∑模数转换器来实现高精度地震勘探数据采集系统的实现思路,对探测传感器或检波器后端数据采集 ...
https://www.eeworm.com/dl/514/12748.html
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教程资料 基于FPGA的多轴控制器设计

介绍了一种基于FPGA的多轴控制器,控制器主要由ARM7(LPC2214)和FPGA(EP2C5T144C8)及其外围电路组成,用于同时控制多路电机的运动。利用Verilog HDL 硬件描述语言在FPGA中实现了电机控制逻辑,主要包括脉冲控制信号产生、加减速控制、编码器反馈信号的辨向和细分、绝对位移记录、限位信号保护逻辑等。论文中给出了FPGA内 ...
https://www.eeworm.com/dl/fpga/doc/32119.html
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教程资料 基于FPGA的DDS IP核设计方案

以Altera公司的Quartus Ⅱ 7.2作为开发工具,研究了基于FPGA的DDS IP核设计,并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件,结合32位嵌入式CPU软核Nios II,构成可编程片上系统(SOPC),利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片 ...
https://www.eeworm.com/dl/fpga/doc/32544.html
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