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6端口寄存器IP内核VHDL源代码，所需的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog BIST 电路IP核的VHDL语言源代码
BIST 电路IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog SoC-Wishbone System IP核的VHDL语言源代码
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VHDL/FPGA/Verilog ARM7系统IP核的VHDL语言源代码
ARM7系统IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog 键盘控制电路IP核的VHDL语言源代码
键盘控制电路IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog SDRAM控制IP核的VHDL语言源代码
SDRAM控制IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog FPGA驱动数码管
FPGA驱动数码管，本人编写的vhdl源程序，QUARTUS II调试成功