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QUARTUS 的查询结果
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VHDL/FPGA/Verilog SoC-Wishbone System IP核的VHDL语言源代码
SoC-Wishbone System IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog ARM7系统IP核的VHDL语言源代码
ARM7系统IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog 键盘控制电路IP核的VHDL语言源代码
键盘控制电路IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
VHDL/FPGA/Verilog SDRAM控制IP核的VHDL语言源代码
SDRAM控制IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。
嵌入式/单片机编程 altera 的i2c ip核
altera 的i2c ip核，可直接调用
在quartus中把库指向文件位置就可
其他 altera 的uart ip核
altera 的uart ip核，可直接调用
在quartus中把库指向文件位置就可
嵌入式/单片机编程 altera 的vga ip核
altera 的vga ip核，可直接调用
在quartus中把库指向文件位置就可
VHDL/FPGA/Verilog eeprom的Verilog HDL源代码
eeprom的Verilog HDL源代码，含eeprom的读写！Quartus II5.0平台测试通过！
VHDL/FPGA/Verilog alter控制VGA输出VHDL源代码 使用方法： 1.拷贝到硬盘
alter控制VGA输出VHDL源代码
使用方法：
1.拷贝到硬盘，用Quartus中新建工程，添加文件即可。