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VHDL/Verilog/EDA源码 基于vhdl的移位寄存器设计
16位带有并行预置功能的右移移位寄存器,CLK1是时钟信号, LOAD是并行数据使能信号,QB是串行输出端口
技术资料 基于vhdl的移位寄存器设计
16位带有并行预置功能的右移移位寄存器,CLK1是时钟信号, LOAD是并行数据使能信号,QB是串行输出端口
单片机编程 Altium Designer元件库和封装库
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单片机编程 温控电机+人机界面(毕业设计)
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