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使用输入时钟脉宽的调整,完成pll时钟输出的微调
论文 A 1-GHz Charge Pump PLL Frequency Synthesizer
1.高频率pll 设计论文
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技术资料 PLL锁相环
PLL(Phase Locked Loop): 为锁相回路或锁相环,用来统一整合时钟信号,使高频器件正常工作,如内存的存取资料等。PLL用于振荡器中的反馈技术。 许多电子设备要正常工作,通常需要外部的输入信号与内部的振荡信号同步。一般的晶振由于工艺与成本原因,做不到很高的频率,而在需要高频应用时,由相应的器件VCO,实现转成高频 ...
技术资料 PLL ADF4350单片机驱动源码keil
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