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教程资料  基于DSP+FPGA的磁铁电源控制器的设计

介绍了一种基于DSP和FPGA的磁铁电源控制器的设计方案，阐述了该控制器硬件系统的组成，包括信号调理电路、中间数据处理部分、后端的驱动电路。同时给出了DSP和FPGA之间通过SPI接口通信的具体流程和输出PWM波形死区部分的控制流程。设计的磁铁电源控制器有很好的控制和运算能力，同时具有很好的灵活性和可靠性。 ...

https://www.eeworm.com/dl/fpga/doc/32438.html

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FPGA DSP 磁铁电源控制器

教程资料  基于FPGA的FIR数字滤波器算法实现

基于FPGA的FIR数字滤波器算法实现

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FPGA FIR 数字滤波器算法

教程资料  基于FPGA部分动态可重构的信号解调系统的实现

&nbsp;&nbsp;&nbsp; 针对调制样式在不同环境下的变化，采用了FPGA部分动态可重构的新方法，通过对不同调制样式信号的解调模块的动态加载，来实现了不同环境下针对不同调制样式的解调。这种方式比传统的设计方式具有更高的灵活性、可扩展性，并减低了成本和功耗。该设计方案同时也介绍了FPGA部分动态可重构的概念和特点，可 ...

https://www.eeworm.com/dl/fpga/doc/32509.html

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FPGA 部分动态可重构信号解调系统

教程资料  用VerilogHDL实现基于FPGA的通用分频器的设计

用VerilogHDL实现基于FPGA的通用分频器的设计

https://www.eeworm.com/dl/fpga/doc/32545.html

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VerilogHDL FPGA 分频器

教程资料  赛灵思如何让7系列FPGA的功耗减半

赛灵思采用专为 FPGA 定制的芯片制造工艺和创新型统一架构，让 7 系列 FPGA 的功耗较前一代器件降低一半以上。

https://www.eeworm.com/dl/fpga/doc/32557.html

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FPGA 赛灵思功耗减

教程资料  降低赛灵思28nm 7系列FPGA的功耗

本白皮书介绍了有关赛灵思 28 nm 7 系列 FPGA 功耗的几个方面，其中包括台积电 28nm高介电层金属闸 (HKMG) 高性能低功耗（28nm HPL 或 28 HPL）工艺的选择。

https://www.eeworm.com/dl/fpga/doc/32559.html

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FPGA 28 nm 赛灵思

教程资料  堆叠与载入赛灵思打造令人惊叹的FPGA

堆叠与载入赛灵思打造令人惊叹的FPGA

https://www.eeworm.com/dl/fpga/doc/32563.html

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FPGA 堆叠赛灵思

教程资料  WP151 - Xilinx FPGA的System ACE配置解决方案

Design techniques for electronic systems areconstantly changing. In industries at the heart of thedigital revolution, this change is especially acute.Functional integration, dramatic increases incomplexity, new standards and protocols, costconstraints, and increased time-to-market pressureshave bo ...

https://www.eeworm.com/dl/fpga/doc/32581.html

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System Xilinx FPGA 151

教程资料  XAPP098 - Spartan FPGA低成本、高效率串行配置

This application note shows how to achieve low-cost, efficient serial configuration for Spartan FPGA designs. The approachrecommended here takes advantage of unused resources in a design, thereby reducing the cost, part count, memory size,and board space associated with the serial configuration ci ...

https://www.eeworm.com/dl/fpga/doc/32590.html

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Spartan XAPP FPGA 098

教程资料  HDLC协议RS485总线控制器的FPGA实现

介绍了HDLC协议RS485总线控制器的FPGA实现

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HDLC FPGA 485 RS

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