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VHDL/FPGA/Verilog altera推出的基于它们fpga和cpld的构建嵌入式系统的新技术sopc的介绍。其集成在quartus II中
altera推出的基于它们fpga和cpld的构建嵌入式系统的新技术sopc的介绍。其集成在quartus II中
微处理器开发 altera nois cpu.Very good.
altera nois cpu.Very good.
VHDL/FPGA/Verilog 使用vhdl语言在altera公司的up3板上产生vga信号
使用vhdl语言在altera公司的up3板上产生vga信号，里面有详细的解析和说明，是一个很好的教程。
VHDL/FPGA/Verilog 使用vhdl语言在altera公司的up3板上产生vga信号
使用vhdl语言在altera公司的up3板上产生vga信号，里面有详细的解析和说明，是一个很好的教程。和上一个文件razzle差不多，但是产生的效果不一样。
VHDL/FPGA/Verilog DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M
DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M
VHDL/FPGA/Verilog Altera的IP源码8259
Altera的IP源码8259，只需打开就能实现
VHDL/FPGA/Verilog 一个很不错的例子,实现的是4bit的加减乘除,用modelsim做的仿真.
一个很不错的例子,实现的是4bit的加减乘除,用modelsim做的仿真.
VHDL/FPGA/Verilog ALTERA NIOS处理器实验
ALTERA NIOS处理器实验，编程环境是QUARTUS，在NIOS SHELL下编译实现功能。实验USB接口
VHDL/FPGA/Verilog ALTERA NIOS处理器
ALTERA NIOS处理器，用VHDL在QUARTUS下编写，用NIOS SHELL调试通过，实验LCD液晶显示
VHDL/FPGA/Verilog ALTERA NIOS处理器实验
ALTERA NIOS处理器实验，QUARTUS下用VHDL编译成处理器，然后NIOS SHELL下C 语言运行。实验SRAM和DMA调度