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VHDL/FPGA/Verilog 基于Verilog HDL 的一个CAN总线IP核。

基于Verilog HDL 的一个CAN总线IP核。

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手册  altera单时钟和双时钟fifo IP核用户向导

altera单时钟和双时钟fifo IP核用户向导，描述了该IP核各个输入和输出端口的含义以及使用方法和注意事项

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altera fifo 时钟 IP核用户

技术资料  Xilinx FPGA应用进阶通用IP核详解和设计开发

本书系统讲解通信网络领域Xilinx FPGA内部的IP硬核。以流行的Xilinx Virtex-6型号芯片举例，涵盖Xilinx FPGA在通信领域主流的IP核，阐述Xilinx FPGA时钟资源和DCM、PLL和MMCM时钟管理器的特性和使用方法；介绍基于Block RAM资源生成ROM、RAM、FIFO和CAM核的使用过程。阐述TEMAC核背景知识、内部结构、接口时序和配置参数 ...

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xilinx fpga ip核

技术资料  基于altera fpga 的单口ram ip核的应用实例

基于altera fpga 的单口ram ip核的应用实例

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altera fpga ram ip核

技术资料  基于FPGA的TFTLCD控制器IP核的设计

该文档为基于FPGA的TFTLCD控制器IP核的设计总结文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………    

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fpga lcd 控制器

技术资料  基于FPGA的GPIB控制器的IP核设计

当前，片上系统(SOC)已成为系统实现的主流技术。流片风险与费用增加、上市时间压力加大、产品功能愈加复杂等因素使得SOC产业逐渐划分为IP提供者、SOC设计服务者和芯片集成者三个层次。SOC设计已走向基于IP集成的平台设计阶段，经过严格验证质量可靠的IP核成为SOC产业中的重要一环。 GPIB控制器芯片是组建自动测试系统的核心 ...

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FPGA GPIB

技术资料  H264视频解码IP核的设计与实现

基于FPGA的H264视频解码IP核的设计与实现

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H264 视频解码 IP核

技术资料  一种可进化IP 核的设计和实现

提出一种可进化IP 核的设计和实现方法。这种IP 核采用进化硬件的设计思想，将遗传算法运用于硬件电路的设计中，使电路能根据当前的环境自动进行内部电路的进化，从而生成最有效的电路，并能在普通的FPG

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进化

技术资料  I2C器件接口IP核的CPLD设计

I2C器件接口IP核的CPLD设计,从原理到设计！

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CPLD 器件

技术资料  MC8051_IP核简单指令的仿真步骤

MC8051_IP核简单指令的仿真步骤，有参考价值可以下载看看

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