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VHDL/FPGA/Verilog
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基于Verilog HDL 的一个CAN总线IP核。
基于Verilog HDL 的一个CAN总线IP核。
VHDL/FPGA/Verilog
88 K
179 次下载
2013-12-08
资源详细信息
文件格式
RAR
文件大小
88 K
资源分类
VHDL/FPGA/Verilog
上传者
cando99
发布时间
2013-12-08 15:58
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179
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基于Verilog HDL 的一个CAN总线IP核。 - 资源详细说明
基于Verilog HDL 的一个CAN总线IP核。
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