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VHDL/FPGA/Verilog 该程序实现的是n位全加器

该程序实现的是n位全加器，首先用与非门实现一位全家器，最后实现n位的全加器。

https://www.eeworm.com/dl/663/142668.html

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VHDL/FPGA/Verilog 该程序实现的N位全减器

该程序实现的N位全减器，首先实现一位的减法器，之后实现N位全减器。

https://www.eeworm.com/dl/663/142669.html

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数值算法/人工智能  给定n 个物品, 物品i重为wi 并且价值为 vi

给定n 个物品, 物品i重为wi 并且价值为 vi ，背包所能承载的最大容量为 W. 0-1 背包问题即是选择含有着最大总价值的物品的子集且它的容量 ≤W ．用动态规划实现

https://www.eeworm.com/dl/518/143404.html

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数据结构  n皇后问题

n皇后问题，可以显示所有的合适路径，典型的回溯算法

https://www.eeworm.com/dl/654/143707.html

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人工智能/神经网络  SOM的学习规则有三个主要阶段： 1）寻找与输入模式xk最接近的连接权向量Wj=（wj1, wj2,….., wjN） 2）将该连接权向量Wj*进一步朝向与输入模式xk接近的方向调整 3

SOM的学习规则有三个主要阶段： 1）寻找与输入模式xk最接近的连接权向量Wj*=（wj*1, wj*2,….., wj*N） 2）将该连接权向量Wj*进一步朝向与输入模式xk接近的方向调整 3）除调整连接权向量Wj*外，还调整邻域内的各个连接权向量，并随着学习次数的增加，逐渐缩小邻域范围 ...

https://www.eeworm.com/dl/650/143848.html

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数据结构  广义表是线性表的推广。广义表是n个元素的有限序列

广义表是线性表的推广。广义表是n个元素的有限序列，元素可以是原子或一个广义表，记为LS。若元素是广义表称它为LS的子表。若广义表非空，则第一个元素称表头，其余元素称表尾。表的深度是指表展开后所含括号的层数。把与树对应的广义表称为纯表，它限制了表中成分的共享和递归；允许结点共享的表称为再入表；允许递归 ...

https://www.eeworm.com/dl/654/144751.html

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