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教程资料 赛灵思如何让7系列FPGA的功耗减半

赛灵思采用专为 FPGA 定制的芯片制造工艺和创新型统一架构,让 7 系列 FPGA 的功耗较前一代器件降低一半以上。
https://www.eeworm.com/dl/fpga/doc/32557.html
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教程资料 降低赛灵思28nm 7系列FPGA的功耗

本白皮书介绍了有关赛灵思 28 nm 7 系列 FPGA 功耗的几个方面,其中包括台积电 28nm高介电层金属闸 (HKMG) 高性能低功耗(28nm HPL 或 28 HPL)工艺的选择。
https://www.eeworm.com/dl/fpga/doc/32559.html
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教程资料 堆叠与载入赛灵思打造令人惊叹的FPGA

堆叠与载入赛灵思打造令人惊叹的FPGA
https://www.eeworm.com/dl/fpga/doc/32563.html
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教程资料 WP151 - Xilinx FPGA的System ACE配置解决方案

Design techniques for electronic systems areconstantly changing. In industries at the heart of thedigital revolution, this change is especially acute.Functional integration, dramatic increases incomplexity, new standards and protocols, costconstraints, and increased time-to-market pressureshave bo ...
https://www.eeworm.com/dl/fpga/doc/32581.html
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教程资料 XAPP098 - Spartan FPGA低成本、高效率串行配置

This application note shows how to achieve low-cost, efficient serial configuration for Spartan FPGA designs. The approachrecommended here takes advantage of unused resources in a design, thereby reducing the cost, part count, memory size,and board space associated with the serial configuration ci ...
https://www.eeworm.com/dl/fpga/doc/32590.html
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教程资料 HDLC协议RS485总线控制器的FPGA实现

介绍了HDLC协议RS485总线控制器的FPGA实现
https://www.eeworm.com/dl/fpga/doc/32598.html
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教程资料 ETL-002 Altera Cyclone III系列FPGA开发板简介

ETL-002 FPGA开发板是以Altera公司的最新系列Cyclone III中的3C10为主芯片,并提供了极为丰富的芯片外围接口资源以及下载线,数据线以及资料光盘等。除了这些硬件外,我们还提供了十多个接口实验,并公开了电路原理图和实验的Verilog源代码,以便于大家对照学习,并可以在该开发板上进行二次开发。 ...
https://www.eeworm.com/dl/fpga/doc/32640.html
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教程资料 基于FPGA的恒温晶振频率校准系统的设计

为满足三维大地电磁勘探技术对多个采集站的同步需求,基于FPGA设计了一种晶振频率校准系统。系统可以调节各采集站的恒温压控晶体振荡器同步于GPS,从而使晶振能够输出高准确度和稳定度的同步信号。系统中使用FPGA设计了高分辨率的时间间隔测量单元,达到0.121 ns的测量分辨率,能对晶振分频信号与GPS秒脉冲信号的时间间隔进 ...
https://www.eeworm.com/dl/fpga/doc/32654.html
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教程资料 基于FPGA的相关干涉仪算法的研究与实现

提出一种利用FPGA实现相关干涉仪测向算法的方法,给出了测向系统的结构和组成框图,并详细介绍了FPGA内部模块的划分及设计流程,最后结合实际设计出一种实现方案,并讨论了该方案在宽带测向中较原有实现方式的优势。为了使算法更适于FPGA实现,提出了一种新的相位样本选取方法,并仿真验证了该方法与传统方法的等效性。 ...
https://www.eeworm.com/dl/fpga/doc/32664.html
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教程资料 基于FPGA的栈空间管理器的研究和设计

提出了一种将堆栈空间划分为任务栈和中断嵌套栈的设计结构,使堆栈空间最小化。采用VHDL硬件语言,在FPGA设备上模拟实现了具有自动检验功能的栈空间管理器。栈空间管理器由不同功能的逻辑模块组成,主要阐述了状态控制逻辑模块和地址产生逻辑模块的设计方法。 ...
https://www.eeworm.com/dl/fpga/doc/32667.html
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